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TOMOYO Linux Cross Reference
Linux/include/dt-bindings/clock/exynos850.h

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Differences between /include/dt-bindings/clock/exynos850.h (Architecture mips) and /include/dt-bindings/clock/exynos850.h (Architecture m68k)


  1 /* SPDX-License-Identifier: (GPL-2.0-only OR B      1 /* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
  2 /*                                                  2 /*
  3  * Copyright (C) 2021 Linaro Ltd.                   3  * Copyright (C) 2021 Linaro Ltd.
  4  * Author: Sam Protsenko <semen.protsenko@lina      4  * Author: Sam Protsenko <semen.protsenko@linaro.org>
  5  *                                                  5  *
  6  * Device Tree binding constants for Exynos850      6  * Device Tree binding constants for Exynos850 clock controller.
  7  */                                                 7  */
  8                                                     8 
  9 #ifndef _DT_BINDINGS_CLOCK_EXYNOS_850_H             9 #ifndef _DT_BINDINGS_CLOCK_EXYNOS_850_H
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 11                                                    11 
 12 /* CMU_TOP */                                      12 /* CMU_TOP */
 13 #define CLK_FOUT_SHARED0_PLL            1          13 #define CLK_FOUT_SHARED0_PLL            1
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101 #define CLK_DOUT_CPUCL1_DBG             89        101 #define CLK_DOUT_CPUCL1_DBG             89
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103                                                   103 
104 /* CMU_APM */                                     104 /* CMU_APM */
105 #define CLK_RCO_I3C_PMIC                1         105 #define CLK_RCO_I3C_PMIC                1
106 #define OSCCLK_RCO_APM                  2         106 #define OSCCLK_RCO_APM                  2
107 #define CLK_RCO_APM__ALV                3         107 #define CLK_RCO_APM__ALV                3
108 #define CLK_DLL_DCO                     4         108 #define CLK_DLL_DCO                     4
109 #define CLK_MOUT_APM_BUS_USER           5         109 #define CLK_MOUT_APM_BUS_USER           5
110 #define CLK_MOUT_RCO_APM_I3C_USER       6         110 #define CLK_MOUT_RCO_APM_I3C_USER       6
111 #define CLK_MOUT_RCO_APM_USER           7         111 #define CLK_MOUT_RCO_APM_USER           7
112 #define CLK_MOUT_DLL_USER               8         112 #define CLK_MOUT_DLL_USER               8
113 #define CLK_MOUT_CLKCMU_CHUB_BUS        9         113 #define CLK_MOUT_CLKCMU_CHUB_BUS        9
114 #define CLK_MOUT_APM_BUS                10        114 #define CLK_MOUT_APM_BUS                10
115 #define CLK_MOUT_APM_I3C                11        115 #define CLK_MOUT_APM_I3C                11
116 #define CLK_DOUT_CLKCMU_CHUB_BUS        12        116 #define CLK_DOUT_CLKCMU_CHUB_BUS        12
117 #define CLK_DOUT_APM_BUS                13        117 #define CLK_DOUT_APM_BUS                13
118 #define CLK_DOUT_APM_I3C                14        118 #define CLK_DOUT_APM_I3C                14
119 #define CLK_GOUT_CLKCMU_CMGP_BUS        15        119 #define CLK_GOUT_CLKCMU_CMGP_BUS        15
120 #define CLK_GOUT_CLKCMU_CHUB_BUS        16        120 #define CLK_GOUT_CLKCMU_CHUB_BUS        16
121 #define CLK_GOUT_RTC_PCLK               17        121 #define CLK_GOUT_RTC_PCLK               17
122 #define CLK_GOUT_TOP_RTC_PCLK           18        122 #define CLK_GOUT_TOP_RTC_PCLK           18
123 #define CLK_GOUT_I3C_PCLK               19        123 #define CLK_GOUT_I3C_PCLK               19
124 #define CLK_GOUT_I3C_SCLK               20        124 #define CLK_GOUT_I3C_SCLK               20
125 #define CLK_GOUT_SPEEDY_PCLK            21        125 #define CLK_GOUT_SPEEDY_PCLK            21
126 #define CLK_GOUT_GPIO_ALIVE_PCLK        22        126 #define CLK_GOUT_GPIO_ALIVE_PCLK        22
127 #define CLK_GOUT_PMU_ALIVE_PCLK         23        127 #define CLK_GOUT_PMU_ALIVE_PCLK         23
128 #define CLK_GOUT_SYSREG_APM_PCLK        24        128 #define CLK_GOUT_SYSREG_APM_PCLK        24
129                                                   129 
130 /* CMU_AUD */                                     130 /* CMU_AUD */
131 #define CLK_DOUT_AUD_AUDIF              1         131 #define CLK_DOUT_AUD_AUDIF              1
132 #define CLK_DOUT_AUD_BUSD               2         132 #define CLK_DOUT_AUD_BUSD               2
133 #define CLK_DOUT_AUD_BUSP               3         133 #define CLK_DOUT_AUD_BUSP               3
134 #define CLK_DOUT_AUD_CNT                4         134 #define CLK_DOUT_AUD_CNT                4
135 #define CLK_DOUT_AUD_CPU                5         135 #define CLK_DOUT_AUD_CPU                5
136 #define CLK_DOUT_AUD_CPU_ACLK           6         136 #define CLK_DOUT_AUD_CPU_ACLK           6
137 #define CLK_DOUT_AUD_CPU_PCLKDBG        7         137 #define CLK_DOUT_AUD_CPU_PCLKDBG        7
138 #define CLK_DOUT_AUD_FM                 8         138 #define CLK_DOUT_AUD_FM                 8
139 #define CLK_DOUT_AUD_FM_SPDY            9         139 #define CLK_DOUT_AUD_FM_SPDY            9
140 #define CLK_DOUT_AUD_MCLK               10        140 #define CLK_DOUT_AUD_MCLK               10
141 #define CLK_DOUT_AUD_UAIF0              11        141 #define CLK_DOUT_AUD_UAIF0              11
142 #define CLK_DOUT_AUD_UAIF1              12        142 #define CLK_DOUT_AUD_UAIF1              12
143 #define CLK_DOUT_AUD_UAIF2              13        143 #define CLK_DOUT_AUD_UAIF2              13
144 #define CLK_DOUT_AUD_UAIF3              14        144 #define CLK_DOUT_AUD_UAIF3              14
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152 #define CLK_GOUT_AUD_CNT_BCLK           22        152 #define CLK_GOUT_AUD_CNT_BCLK           22
153 #define CLK_GOUT_AUD_CODEC_MCLK         23        153 #define CLK_GOUT_AUD_CODEC_MCLK         23
154 #define CLK_GOUT_AUD_DAP_CCLK           24        154 #define CLK_GOUT_AUD_DAP_CCLK           24
155 #define CLK_GOUT_AUD_GPIO_PCLK          25        155 #define CLK_GOUT_AUD_GPIO_PCLK          25
156 #define CLK_GOUT_AUD_PPMU_ACLK          26        156 #define CLK_GOUT_AUD_PPMU_ACLK          26
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159 #define CLK_GOUT_AUD_SYSMMU_CLK         29        159 #define CLK_GOUT_AUD_SYSMMU_CLK         29
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164 #define CLK_GOUT_AUD_UAIF2_BCLK         34        164 #define CLK_GOUT_AUD_UAIF2_BCLK         34
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169 #define CLK_GOUT_AUD_WDT_PCLK           39        169 #define CLK_GOUT_AUD_WDT_PCLK           39
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172 #define CLK_MOUT_AUD_CPU_USER           42        172 #define CLK_MOUT_AUD_CPU_USER           42
173 #define CLK_MOUT_AUD_FM                 43        173 #define CLK_MOUT_AUD_FM                 43
174 #define CLK_MOUT_AUD_PLL                44        174 #define CLK_MOUT_AUD_PLL                44
175 #define CLK_MOUT_AUD_TICK_USB_USER      45        175 #define CLK_MOUT_AUD_TICK_USB_USER      45
176 #define CLK_MOUT_AUD_UAIF0              46        176 #define CLK_MOUT_AUD_UAIF0              46
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180 #define CLK_MOUT_AUD_UAIF4              50        180 #define CLK_MOUT_AUD_UAIF4              50
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189 #define IOCLK_AUDIOCDCLK6               59        189 #define IOCLK_AUDIOCDCLK6               59
190 #define TICK_USB                        60        190 #define TICK_USB                        60
191 #define CLK_GOUT_AUD_CMU_AUD_PCLK       61        191 #define CLK_GOUT_AUD_CMU_AUD_PCLK       61
192                                                   192 
193 /* CMU_CMGP */                                    193 /* CMU_CMGP */
194 #define CLK_RCO_CMGP                    1         194 #define CLK_RCO_CMGP                    1
195 #define CLK_MOUT_CMGP_ADC               2         195 #define CLK_MOUT_CMGP_ADC               2
196 #define CLK_MOUT_CMGP_USI0              3         196 #define CLK_MOUT_CMGP_USI0              3
197 #define CLK_MOUT_CMGP_USI1              4         197 #define CLK_MOUT_CMGP_USI1              4
198 #define CLK_DOUT_CMGP_ADC               5         198 #define CLK_DOUT_CMGP_ADC               5
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201 #define CLK_GOUT_CMGP_ADC_S0_PCLK       8         201 #define CLK_GOUT_CMGP_ADC_S0_PCLK       8
202 #define CLK_GOUT_CMGP_ADC_S1_PCLK       9         202 #define CLK_GOUT_CMGP_ADC_S1_PCLK       9
203 #define CLK_GOUT_CMGP_GPIO_PCLK         10        203 #define CLK_GOUT_CMGP_GPIO_PCLK         10
204 #define CLK_GOUT_CMGP_USI0_IPCLK        11        204 #define CLK_GOUT_CMGP_USI0_IPCLK        11
205 #define CLK_GOUT_CMGP_USI0_PCLK         12        205 #define CLK_GOUT_CMGP_USI0_PCLK         12
206 #define CLK_GOUT_CMGP_USI1_IPCLK        13        206 #define CLK_GOUT_CMGP_USI1_IPCLK        13
207 #define CLK_GOUT_CMGP_USI1_PCLK         14        207 #define CLK_GOUT_CMGP_USI1_PCLK         14
208 #define CLK_GOUT_SYSREG_CMGP_PCLK       15        208 #define CLK_GOUT_SYSREG_CMGP_PCLK       15
209                                                   209 
210 /* CMU_CPUCL0 */                                  210 /* CMU_CPUCL0 */
211 #define CLK_FOUT_CPUCL0_PLL             1         211 #define CLK_FOUT_CPUCL0_PLL             1
212 #define CLK_MOUT_PLL_CPUCL0             2         212 #define CLK_MOUT_PLL_CPUCL0             2
213 #define CLK_MOUT_CPUCL0_SWITCH_USER     3         213 #define CLK_MOUT_CPUCL0_SWITCH_USER     3
214 #define CLK_MOUT_CPUCL0_DBG_USER        4         214 #define CLK_MOUT_CPUCL0_DBG_USER        4
215 #define CLK_MOUT_CPUCL0_PLL             5         215 #define CLK_MOUT_CPUCL0_PLL             5
216 #define CLK_DOUT_CPUCL0_CPU             6         216 #define CLK_DOUT_CPUCL0_CPU             6
217 #define CLK_DOUT_CPUCL0_CMUREF          7         217 #define CLK_DOUT_CPUCL0_CMUREF          7
218 #define CLK_DOUT_CPUCL0_PCLK            8         218 #define CLK_DOUT_CPUCL0_PCLK            8
219 #define CLK_DOUT_CLUSTER0_ACLK          9         219 #define CLK_DOUT_CLUSTER0_ACLK          9
220 #define CLK_DOUT_CLUSTER0_ATCLK         10        220 #define CLK_DOUT_CLUSTER0_ATCLK         10
221 #define CLK_DOUT_CLUSTER0_PCLKDBG       11        221 #define CLK_DOUT_CLUSTER0_PCLKDBG       11
222 #define CLK_DOUT_CLUSTER0_PERIPHCLK     12        222 #define CLK_DOUT_CLUSTER0_PERIPHCLK     12
223 #define CLK_GOUT_CLUSTER0_ATCLK         13        223 #define CLK_GOUT_CLUSTER0_ATCLK         13
224 #define CLK_GOUT_CLUSTER0_PCLK          14        224 #define CLK_GOUT_CLUSTER0_PCLK          14
225 #define CLK_GOUT_CLUSTER0_PERIPHCLK     15        225 #define CLK_GOUT_CLUSTER0_PERIPHCLK     15
226 #define CLK_GOUT_CLUSTER0_SCLK          16        226 #define CLK_GOUT_CLUSTER0_SCLK          16
227 #define CLK_GOUT_CPUCL0_CMU_CPUCL0_PCLK 17        227 #define CLK_GOUT_CPUCL0_CMU_CPUCL0_PCLK 17
228 #define CLK_GOUT_CLUSTER0_CPU           18        228 #define CLK_GOUT_CLUSTER0_CPU           18
229 #define CLK_CLUSTER0_SCLK               19        229 #define CLK_CLUSTER0_SCLK               19
230                                                   230 
231 /* CMU_CPUCL1 */                                  231 /* CMU_CPUCL1 */
232 #define CLK_FOUT_CPUCL1_PLL             1         232 #define CLK_FOUT_CPUCL1_PLL             1
233 #define CLK_MOUT_PLL_CPUCL1             2         233 #define CLK_MOUT_PLL_CPUCL1             2
234 #define CLK_MOUT_CPUCL1_SWITCH_USER     3         234 #define CLK_MOUT_CPUCL1_SWITCH_USER     3
235 #define CLK_MOUT_CPUCL1_DBG_USER        4         235 #define CLK_MOUT_CPUCL1_DBG_USER        4
236 #define CLK_MOUT_CPUCL1_PLL             5         236 #define CLK_MOUT_CPUCL1_PLL             5
237 #define CLK_DOUT_CPUCL1_CPU             6         237 #define CLK_DOUT_CPUCL1_CPU             6
238 #define CLK_DOUT_CPUCL1_CMUREF          7         238 #define CLK_DOUT_CPUCL1_CMUREF          7
239 #define CLK_DOUT_CPUCL1_PCLK            8         239 #define CLK_DOUT_CPUCL1_PCLK            8
240 #define CLK_DOUT_CLUSTER1_ACLK          9         240 #define CLK_DOUT_CLUSTER1_ACLK          9
241 #define CLK_DOUT_CLUSTER1_ATCLK         10        241 #define CLK_DOUT_CLUSTER1_ATCLK         10
242 #define CLK_DOUT_CLUSTER1_PCLKDBG       11        242 #define CLK_DOUT_CLUSTER1_PCLKDBG       11
243 #define CLK_DOUT_CLUSTER1_PERIPHCLK     12        243 #define CLK_DOUT_CLUSTER1_PERIPHCLK     12
244 #define CLK_GOUT_CLUSTER1_ATCLK         13        244 #define CLK_GOUT_CLUSTER1_ATCLK         13
245 #define CLK_GOUT_CLUSTER1_PCLK          14        245 #define CLK_GOUT_CLUSTER1_PCLK          14
246 #define CLK_GOUT_CLUSTER1_PERIPHCLK     15        246 #define CLK_GOUT_CLUSTER1_PERIPHCLK     15
247 #define CLK_GOUT_CLUSTER1_SCLK          16        247 #define CLK_GOUT_CLUSTER1_SCLK          16
248 #define CLK_GOUT_CPUCL1_CMU_CPUCL1_PCLK 17        248 #define CLK_GOUT_CPUCL1_CMU_CPUCL1_PCLK 17
249 #define CLK_GOUT_CLUSTER1_CPU           18        249 #define CLK_GOUT_CLUSTER1_CPU           18
250 #define CLK_CLUSTER1_SCLK               19        250 #define CLK_CLUSTER1_SCLK               19
251                                                   251 
252 /* CMU_G3D */                                     252 /* CMU_G3D */
253 #define CLK_FOUT_G3D_PLL                1         253 #define CLK_FOUT_G3D_PLL                1
254 #define CLK_MOUT_G3D_PLL                2         254 #define CLK_MOUT_G3D_PLL                2
255 #define CLK_MOUT_G3D_SWITCH_USER        3         255 #define CLK_MOUT_G3D_SWITCH_USER        3
256 #define CLK_MOUT_G3D_BUSD               4         256 #define CLK_MOUT_G3D_BUSD               4
257 #define CLK_DOUT_G3D_BUSP               5         257 #define CLK_DOUT_G3D_BUSP               5
258 #define CLK_GOUT_G3D_CMU_G3D_PCLK       6         258 #define CLK_GOUT_G3D_CMU_G3D_PCLK       6
259 #define CLK_GOUT_G3D_GPU_CLK            7         259 #define CLK_GOUT_G3D_GPU_CLK            7
260 #define CLK_GOUT_G3D_TZPC_PCLK          8         260 #define CLK_GOUT_G3D_TZPC_PCLK          8
261 #define CLK_GOUT_G3D_GRAY2BIN_CLK       9         261 #define CLK_GOUT_G3D_GRAY2BIN_CLK       9
262 #define CLK_GOUT_G3D_BUSD_CLK           10        262 #define CLK_GOUT_G3D_BUSD_CLK           10
263 #define CLK_GOUT_G3D_BUSP_CLK           11        263 #define CLK_GOUT_G3D_BUSP_CLK           11
264 #define CLK_GOUT_G3D_SYSREG_PCLK        12        264 #define CLK_GOUT_G3D_SYSREG_PCLK        12
265                                                   265 
266 /* CMU_HSI */                                     266 /* CMU_HSI */
267 #define CLK_MOUT_HSI_BUS_USER           1         267 #define CLK_MOUT_HSI_BUS_USER           1
268 #define CLK_MOUT_HSI_MMC_CARD_USER      2         268 #define CLK_MOUT_HSI_MMC_CARD_USER      2
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270 #define CLK_MOUT_HSI_RTC                4         270 #define CLK_MOUT_HSI_RTC                4
271 #define CLK_GOUT_USB_RTC_CLK            5         271 #define CLK_GOUT_USB_RTC_CLK            5
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273 #define CLK_GOUT_USB_PHY_REF_CLK        7         273 #define CLK_GOUT_USB_PHY_REF_CLK        7
274 #define CLK_GOUT_USB_PHY_ACLK           8         274 #define CLK_GOUT_USB_PHY_ACLK           8
275 #define CLK_GOUT_USB_BUS_EARLY_CLK      9         275 #define CLK_GOUT_USB_BUS_EARLY_CLK      9
276 #define CLK_GOUT_GPIO_HSI_PCLK          10        276 #define CLK_GOUT_GPIO_HSI_PCLK          10
277 #define CLK_GOUT_MMC_CARD_ACLK          11        277 #define CLK_GOUT_MMC_CARD_ACLK          11
278 #define CLK_GOUT_MMC_CARD_SDCLKIN       12        278 #define CLK_GOUT_MMC_CARD_SDCLKIN       12
279 #define CLK_GOUT_SYSREG_HSI_PCLK        13        279 #define CLK_GOUT_SYSREG_HSI_PCLK        13
280 #define CLK_GOUT_HSI_PPMU_ACLK          14        280 #define CLK_GOUT_HSI_PPMU_ACLK          14
281 #define CLK_GOUT_HSI_PPMU_PCLK          15        281 #define CLK_GOUT_HSI_PPMU_PCLK          15
282 #define CLK_GOUT_HSI_CMU_HSI_PCLK       16        282 #define CLK_GOUT_HSI_CMU_HSI_PCLK       16
283                                                   283 
284 /* CMU_IS */                                      284 /* CMU_IS */
285 #define CLK_MOUT_IS_BUS_USER            1         285 #define CLK_MOUT_IS_BUS_USER            1
286 #define CLK_MOUT_IS_ITP_USER            2         286 #define CLK_MOUT_IS_ITP_USER            2
287 #define CLK_MOUT_IS_VRA_USER            3         287 #define CLK_MOUT_IS_VRA_USER            3
288 #define CLK_MOUT_IS_GDC_USER            4         288 #define CLK_MOUT_IS_GDC_USER            4
289 #define CLK_DOUT_IS_BUSP                5         289 #define CLK_DOUT_IS_BUSP                5
290 #define CLK_GOUT_IS_CMU_IS_PCLK         6         290 #define CLK_GOUT_IS_CMU_IS_PCLK         6
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295 #define CLK_GOUT_IS_CSIS_DMA_CLK        11        295 #define CLK_GOUT_IS_CSIS_DMA_CLK        11
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297 #define CLK_GOUT_IS_IPP_CLK             13        297 #define CLK_GOUT_IS_IPP_CLK             13
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299 #define CLK_GOUT_IS_MCSC_CLK            15        299 #define CLK_GOUT_IS_MCSC_CLK            15
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308                                                   308 
309 /* CMU_MFCMSCL */                                 309 /* CMU_MFCMSCL */
310 #define CLK_MOUT_MFCMSCL_MFC_USER                 310 #define CLK_MOUT_MFCMSCL_MFC_USER               1
311 #define CLK_MOUT_MFCMSCL_M2M_USER                 311 #define CLK_MOUT_MFCMSCL_M2M_USER               2
312 #define CLK_MOUT_MFCMSCL_MCSC_USER                312 #define CLK_MOUT_MFCMSCL_MCSC_USER              3
313 #define CLK_MOUT_MFCMSCL_JPEG_USER                313 #define CLK_MOUT_MFCMSCL_JPEG_USER              4
314 #define CLK_DOUT_MFCMSCL_BUSP                     314 #define CLK_DOUT_MFCMSCL_BUSP                   5
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325                                                   325 
326 /* CMU_PERI */                                    326 /* CMU_PERI */
327 #define CLK_MOUT_PERI_BUS_USER          1         327 #define CLK_MOUT_PERI_BUS_USER          1
328 #define CLK_MOUT_PERI_UART_USER         2         328 #define CLK_MOUT_PERI_UART_USER         2
329 #define CLK_MOUT_PERI_HSI2C_USER        3         329 #define CLK_MOUT_PERI_HSI2C_USER        3
330 #define CLK_MOUT_PERI_SPI_USER          4         330 #define CLK_MOUT_PERI_SPI_USER          4
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339 #define CLK_GOUT_HSI2C0_IPCLK           13        339 #define CLK_GOUT_HSI2C0_IPCLK           13
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361                                                   361 
362 /* CMU_CORE */                                    362 /* CMU_CORE */
363 #define CLK_MOUT_CORE_BUS_USER          1         363 #define CLK_MOUT_CORE_BUS_USER          1
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380 /* CMU_DPU */                                     380 /* CMU_DPU */
381 #define CLK_MOUT_DPU_USER               1         381 #define CLK_MOUT_DPU_USER               1
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392                                                   392 
393 #endif /* _DT_BINDINGS_CLOCK_EXYNOS_850_H */      393 #endif /* _DT_BINDINGS_CLOCK_EXYNOS_850_H */
394                                                   394 

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