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TOMOYO Linux Cross Reference
Linux/include/dt-bindings/clock/google,gs101.h

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Differences between /include/dt-bindings/clock/google,gs101.h (Architecture i386) and /include/dt-bindings/clock/google,gs101.h (Architecture ppc)


  1 /* SPDX-License-Identifier: (GPL-2.0-only OR B      1 /* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
  2 /*                                                  2 /*
  3  * Copyright (C) 2023 Linaro Ltd.                   3  * Copyright (C) 2023 Linaro Ltd.
  4  * Author: Peter Griffin <peter.griffin@linaro      4  * Author: Peter Griffin <peter.griffin@linaro.org>
  5  *                                                  5  *
  6  * Device Tree binding constants for Google gs      6  * Device Tree binding constants for Google gs101 clock controller.
  7  */                                                 7  */
  8                                                     8 
  9 #ifndef _DT_BINDINGS_CLOCK_GOOGLE_GS101_H           9 #ifndef _DT_BINDINGS_CLOCK_GOOGLE_GS101_H
 10 #define _DT_BINDINGS_CLOCK_GOOGLE_GS101_H          10 #define _DT_BINDINGS_CLOCK_GOOGLE_GS101_H
 11                                                    11 
 12 /* CMU_TOP PLL */                                  12 /* CMU_TOP PLL */
 13 #define CLK_FOUT_SHARED0_PLL            1          13 #define CLK_FOUT_SHARED0_PLL            1
 14 #define CLK_FOUT_SHARED1_PLL            2          14 #define CLK_FOUT_SHARED1_PLL            2
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 18                                                    18 
 19 /* CMU_TOP MUX */                                  19 /* CMU_TOP MUX */
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167                                                   167 
168 /* CMU_TOP Gates */                               168 /* CMU_TOP Gates */
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242                                                   242 
243 /* CMU_APM */                                     243 /* CMU_APM */
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340 #define CLK_GOUT_HSI0_LHM_AXI_P_AOCHSI0_I_CLK     340 #define CLK_GOUT_HSI0_LHM_AXI_P_AOCHSI0_I_CLK                   24
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353 #define CLK_GOUT_HSI0_UASC_HSI0_CTRL_ACLK         353 #define CLK_GOUT_HSI0_UASC_HSI0_CTRL_ACLK                       37
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362 #define CLK_GOUT_HSI0_USB31DRD_I_USBDPPHY_SCL_    362 #define CLK_GOUT_HSI0_USB31DRD_I_USBDPPHY_SCL_APB_PCLK          46
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364 #define CLK_GOUT_HSI0_USB31DRD_USBDPPHY_I_ACLK    364 #define CLK_GOUT_HSI0_USB31DRD_USBDPPHY_I_ACLK                  48
365 #define CLK_GOUT_HSI0_USB31DRD_USBDPPHY_UDBG_I    365 #define CLK_GOUT_HSI0_USB31DRD_USBDPPHY_UDBG_I_APB_PCLK         49
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369                                                   369 
370 /* CMU_HSI2 */                                    370 /* CMU_HSI2 */
371 #define CLK_MOUT_HSI2_BUS_USER                    371 #define CLK_MOUT_HSI2_BUS_USER                                          1
372 #define CLK_MOUT_HSI2_MMC_CARD_USER               372 #define CLK_MOUT_HSI2_MMC_CARD_USER                                     2
373 #define CLK_MOUT_HSI2_PCIE_USER                   373 #define CLK_MOUT_HSI2_PCIE_USER                                         3
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384 #define CLK_GOUT_HSI2_HSI2_CMU_HSI2_PCLK          384 #define CLK_GOUT_HSI2_HSI2_CMU_HSI2_PCLK                                14
385 #define CLK_GOUT_HSI2_LHM_AXI_P_HSI2_I_CLK        385 #define CLK_GOUT_HSI2_LHM_AXI_P_HSI2_I_CLK                              15
386 #define CLK_GOUT_HSI2_LHS_ACEL_D_HSI2_I_CLK       386 #define CLK_GOUT_HSI2_LHS_ACEL_D_HSI2_I_CLK                             16
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394 #define CLK_GOUT_HSI2_PCIE_GEN4_1_PCIE_004_MST    394 #define CLK_GOUT_HSI2_PCIE_GEN4_1_PCIE_004_MSTR_ACLK_UG                 24
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396 #define CLK_GOUT_HSI2_PCIE_GEN4_1_PCIE_004_I_D    396 #define CLK_GOUT_HSI2_PCIE_GEN4_1_PCIE_004_I_DRIVER_APB_CLK             26
397 #define CLK_GOUT_HSI2_PCIE_GEN4_1_PCS_PMA_PHY_    397 #define CLK_GOUT_HSI2_PCIE_GEN4_1_PCS_PMA_PHY_UDBG_I_APB_PCLK           27
398 #define CLK_GOUT_HSI2_PCIE_GEN4_1_PCS_PMA_PIPE    398 #define CLK_GOUT_HSI2_PCIE_GEN4_1_PCS_PMA_PIPE_PAL_PCIE_I_APB_PCLK      28
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400 #define CLK_GOUT_HSI2_PCIE_IA_GEN4A_1_I_CLK       400 #define CLK_GOUT_HSI2_PCIE_IA_GEN4A_1_I_CLK                             30
401 #define CLK_GOUT_HSI2_PCIE_IA_GEN4B_1_I_CLK       401 #define CLK_GOUT_HSI2_PCIE_IA_GEN4B_1_I_CLK                             31
402 #define CLK_GOUT_HSI2_PPMU_HSI2_ACLK              402 #define CLK_GOUT_HSI2_PPMU_HSI2_ACLK                                    32
403 #define CLK_GOUT_HSI2_PPMU_HSI2_PCLK              403 #define CLK_GOUT_HSI2_PPMU_HSI2_PCLK                                    33
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