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A 4 */ 5 6 #ifndef _DT_BINDINGS_CLK_MSM_GCC_8974_H 7 #define _DT_BINDINGS_CLK_MSM_GCC_8974_H 8 9 #define GPLL0 10 #define GPLL0_VOTE 11 #define CONFIG_NOC_CLK_SRC 12 #define GPLL2 13 #define GPLL2_VOTE 14 #define GPLL3 15 #define GPLL3_VOTE 16 #define PERIPH_NOC_CLK_SRC 17 #define BLSP_UART_SIM_CLK_SRC 18 #define QDSS_TSCTR_CLK_SRC 19 #define BIMC_DDR_CLK_SRC 20 #define SYSTEM_NOC_CLK_SRC 21 #define GPLL1 22 #define GPLL1_VOTE 23 #define RPM_CLK_SRC 24 #define GCC_BIMC_CLK 25 #define BIMC_DDR_CPLL0_ROOT_CLK_SRC 26 #define KPSS_AHB_CLK_SRC 27 #define QDSS_AT_CLK_SRC 28 #define USB30_MASTER_CLK_SRC 29 #define BIMC_DDR_CPLL1_ROOT_CLK_SRC 30 #define QDSS_STM_CLK_SRC 31 #define ACC_CLK_SRC 32 #define SEC_CTRL_CLK_SRC 33 #define BLSP1_QUP1_I2C_APPS_CLK_SRC 34 #define BLSP1_QUP1_SPI_APPS_CLK_SRC 35 #define BLSP1_QUP2_I2C_APPS_CLK_SRC 36 #define BLSP1_QUP2_SPI_APPS_CLK_SRC 37 #define BLSP1_QUP3_I2C_APPS_CLK_SRC 38 #define BLSP1_QUP3_SPI_APPS_CLK_SRC 39 #define BLSP1_QUP4_I2C_APPS_CLK_SRC 40 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