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TOMOYO Linux Cross Reference
Linux/include/dt-bindings/clock/qcom,gcc-msm8998.h

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Differences between /include/dt-bindings/clock/qcom,gcc-msm8998.h (Version linux-6.11-rc3) and /include/dt-bindings/clock/qcom,gcc-msm8998.h (Version linux-4.14.336)


  1 /* SPDX-License-Identifier: GPL-2.0-only */         1 
  2 /*                                                
  3  * Copyright (c) 2016, The Linux Foundation. A    
  4  */                                               
  5                                                   
  6 #ifndef _DT_BINDINGS_CLK_MSM_GCC_COBALT_H         
  7 #define _DT_BINDINGS_CLK_MSM_GCC_COBALT_H         
  8                                                   
  9 #define BLSP1_QUP1_I2C_APPS_CLK_SRC               
 10 #define BLSP1_QUP1_SPI_APPS_CLK_SRC               
 11 #define BLSP1_QUP2_I2C_APPS_CLK_SRC               
 12 #define BLSP1_QUP2_SPI_APPS_CLK_SRC               
 13 #define BLSP1_QUP3_I2C_APPS_CLK_SRC               
 14 #define BLSP1_QUP3_SPI_APPS_CLK_SRC               
 15 #define BLSP1_QUP4_I2C_APPS_CLK_SRC               
 16 #define BLSP1_QUP4_SPI_APPS_CLK_SRC               
 17 #define BLSP1_QUP5_I2C_APPS_CLK_SRC               
 18 #define BLSP1_QUP5_SPI_APPS_CLK_SRC               
 19 #define BLSP1_QUP6_I2C_APPS_CLK_SRC               
 20 #define BLSP1_QUP6_SPI_APPS_CLK_SRC               
 21 #define BLSP1_UART1_APPS_CLK_SRC                  
 22 #define BLSP1_UART2_APPS_CLK_SRC                  
 23 #define BLSP1_UART3_APPS_CLK_SRC                  
 24 #define BLSP2_QUP1_I2C_APPS_CLK_SRC               
 25 #define BLSP2_QUP1_SPI_APPS_CLK_SRC               
 26 #define BLSP2_QUP2_I2C_APPS_CLK_SRC               
 27 #define BLSP2_QUP2_SPI_APPS_CLK_SRC               
 28 #define BLSP2_QUP3_I2C_APPS_CLK_SRC               
 29 #define BLSP2_QUP3_SPI_APPS_CLK_SRC               
 30 #define BLSP2_QUP4_I2C_APPS_CLK_SRC               
 31 #define BLSP2_QUP4_SPI_APPS_CLK_SRC               
 32 #define BLSP2_QUP5_I2C_APPS_CLK_SRC               
 33 #define BLSP2_QUP5_SPI_APPS_CLK_SRC               
 34 #define BLSP2_QUP6_I2C_APPS_CLK_SRC               
 35 #define BLSP2_QUP6_SPI_APPS_CLK_SRC               
 36 #define BLSP2_UART1_APPS_CLK_SRC                  
 37 #define BLSP2_UART2_APPS_CLK_SRC                  
 38 #define BLSP2_UART3_APPS_CLK_SRC                  
 39 #define GCC_AGGRE1_NOC_XO_CLK                     
 40 #define GCC_AGGRE1_UFS_AXI_CLK                    
 41 #define GCC_AGGRE1_USB3_AXI_CLK                   
 42 #define GCC_APSS_QDSS_TSCTR_DIV2_CLK              
 43 #define GCC_APSS_QDSS_TSCTR_DIV8_CLK              
 44 #define GCC_BIMC_HMSS_AXI_CLK                     
 45 #define GCC_BIMC_MSS_Q6_AXI_CLK                   
 46 #define GCC_BLSP1_AHB_CLK                         
 47 #define GCC_BLSP1_QUP1_I2C_APPS_CLK               
 48 #define GCC_BLSP1_QUP1_SPI_APPS_CLK               
 49 #define GCC_BLSP1_QUP2_I2C_APPS_CLK               
 50 #define GCC_BLSP1_QUP2_SPI_APPS_CLK               
 51 #define GCC_BLSP1_QUP3_I2C_APPS_CLK               
 52 #define GCC_BLSP1_QUP3_SPI_APPS_CLK               
 53 #define GCC_BLSP1_QUP4_I2C_APPS_CLK               
 54 #define GCC_BLSP1_QUP4_SPI_APPS_CLK               
 55 #define GCC_BLSP1_QUP5_I2C_APPS_CLK               
 56 #define GCC_BLSP1_QUP5_SPI_APPS_CLK               
 57 #define GCC_BLSP1_QUP6_I2C_APPS_CLK               
 58 #define GCC_BLSP1_QUP6_SPI_APPS_CLK               
 59 #define GCC_BLSP1_SLEEP_CLK                       
 60 #define GCC_BLSP1_UART1_APPS_CLK                  
 61 #define GCC_BLSP1_UART2_APPS_CLK                  
 62 #define GCC_BLSP1_UART3_APPS_CLK                  
 63 #define GCC_BLSP2_AHB_CLK                         
 64 #define GCC_BLSP2_QUP1_I2C_APPS_CLK               
 65 #define GCC_BLSP2_QUP1_SPI_APPS_CLK               
 66 #define GCC_BLSP2_QUP2_I2C_APPS_CLK               
 67 #define GCC_BLSP2_QUP2_SPI_APPS_CLK               
 68 #define GCC_BLSP2_QUP3_I2C_APPS_CLK               
 69 #define GCC_BLSP2_QUP3_SPI_APPS_CLK               
 70 #define GCC_BLSP2_QUP4_I2C_APPS_CLK               
 71 #define GCC_BLSP2_QUP4_SPI_APPS_CLK               
 72 #define GCC_BLSP2_QUP5_I2C_APPS_CLK               
 73 #define GCC_BLSP2_QUP5_SPI_APPS_CLK               
 74 #define GCC_BLSP2_QUP6_I2C_APPS_CLK               
 75 #define GCC_BLSP2_QUP6_SPI_APPS_CLK               
 76 #define GCC_BLSP2_SLEEP_CLK                       
 77 #define GCC_BLSP2_UART1_APPS_CLK                  
 78 #define GCC_BLSP2_UART2_APPS_CLK                  
 79 #define GCC_BLSP2_UART3_APPS_CLK                  
 80 #define GCC_CFG_NOC_USB3_AXI_CLK                  
 81 #define GCC_GP1_CLK                               
 82 #define GCC_GP2_CLK                               
 83 #define GCC_GP3_CLK                               
 84 #define GCC_GPU_BIMC_GFX_CLK                      
 85 #define GCC_GPU_BIMC_GFX_SRC_CLK                  
 86 #define GCC_GPU_CFG_AHB_CLK                       
 87 #define GCC_GPU_SNOC_DVM_GFX_CLK                  
 88 #define GCC_HMSS_AHB_CLK                          
 89 #define GCC_HMSS_AT_CLK                           
 90 #define GCC_HMSS_DVM_BUS_CLK                      
 91 #define GCC_HMSS_RBCPR_CLK                        
 92 #define GCC_HMSS_TRIG_CLK                         
 93 #define GCC_LPASS_AT_CLK                          
 94 #define GCC_LPASS_TRIG_CLK                        
 95 #define GCC_MMSS_NOC_CFG_AHB_CLK                  
 96 #define GCC_MMSS_QM_AHB_CLK                       
 97 #define GCC_MMSS_QM_CORE_CLK                      
 98 #define GCC_MMSS_SYS_NOC_AXI_CLK                  
 99 #define GCC_MSS_AT_CLK                            
100 #define GCC_PCIE_0_AUX_CLK                        
101 #define GCC_PCIE_0_CFG_AHB_CLK                    
102 #define GCC_PCIE_0_MSTR_AXI_CLK                   
103 #define GCC_PCIE_0_PIPE_CLK                       
104 #define GCC_PCIE_0_SLV_AXI_CLK                    
105 #define GCC_PCIE_PHY_AUX_CLK                      
106 #define GCC_PDM2_CLK                              
107 #define GCC_PDM_AHB_CLK                           
108 #define GCC_PDM_XO4_CLK                           
109 #define GCC_PRNG_AHB_CLK                          
110 #define GCC_SDCC2_AHB_CLK                         
111 #define GCC_SDCC2_APPS_CLK                        
112 #define GCC_SDCC4_AHB_CLK                         
113 #define GCC_SDCC4_APPS_CLK                        
114 #define GCC_TSIF_AHB_CLK                          
115 #define GCC_TSIF_INACTIVITY_TIMERS_CLK            
116 #define GCC_TSIF_REF_CLK                          
117 #define GCC_UFS_AHB_CLK                           
118 #define GCC_UFS_AXI_CLK                           
119 #define GCC_UFS_ICE_CORE_CLK                      
120 #define GCC_UFS_PHY_AUX_CLK                       
121 #define GCC_UFS_RX_SYMBOL_0_CLK                   
122 #define GCC_UFS_RX_SYMBOL_1_CLK                   
123 #define GCC_UFS_TX_SYMBOL_0_CLK                   
124 #define GCC_UFS_UNIPRO_CORE_CLK                   
125 #define GCC_USB30_MASTER_CLK                      
126 #define GCC_USB30_MOCK_UTMI_CLK                   
127 #define GCC_USB30_SLEEP_CLK                       
128 #define GCC_USB3_PHY_AUX_CLK                      
129 #define GCC_USB3_PHY_PIPE_CLK                     
130 #define GCC_USB_PHY_CFG_AHB2PHY_CLK               
131 #define GP1_CLK_SRC                               
132 #define GP2_CLK_SRC                               
133 #define GP3_CLK_SRC                               
134 #define GPLL0                                     
135 #define GPLL0_OUT_EVEN                            
136 #define GPLL0_OUT_MAIN                            
137 #define GPLL0_OUT_ODD                             
138 #define GPLL0_OUT_TEST                            
139 #define GPLL1                                     
140 #define GPLL1_OUT_EVEN                            
141 #define GPLL1_OUT_MAIN                            
142 #define GPLL1_OUT_ODD                             
143 #define GPLL1_OUT_TEST                            
144 #define GPLL2                                     
145 #define GPLL2_OUT_EVEN                            
146 #define GPLL2_OUT_MAIN                            
147 #define GPLL2_OUT_ODD                             
148 #define GPLL2_OUT_TEST                            
149 #define GPLL3                                     
150 #define GPLL3_OUT_EVEN                            
151 #define GPLL3_OUT_MAIN                            
152 #define GPLL3_OUT_ODD                             
153 #define GPLL3_OUT_TEST                            
154 #define GPLL4                                     
155 #define GPLL4_OUT_EVEN                            
156 #define GPLL4_OUT_MAIN                            
157 #define GPLL4_OUT_ODD                             
158 #define GPLL4_OUT_TEST                            
159 #define GPLL6                                     
160 #define GPLL6_OUT_EVEN                            
161 #define GPLL6_OUT_MAIN                            
162 #define GPLL6_OUT_ODD                             
163 #define GPLL6_OUT_TEST                            
164 #define HMSS_AHB_CLK_SRC                          
165 #define HMSS_RBCPR_CLK_SRC                        
166 #define PCIE_AUX_CLK_SRC                          
167 #define PDM2_CLK_SRC                              
168 #define SDCC2_APPS_CLK_SRC                        
169 #define SDCC4_APPS_CLK_SRC                        
170 #define TSIF_REF_CLK_SRC                          
171 #define UFS_AXI_CLK_SRC                           
172 #define USB30_MASTER_CLK_SRC                      
173 #define USB30_MOCK_UTMI_CLK_SRC                   
174 #define USB3_PHY_AUX_CLK_SRC                      
175 #define GCC_USB3_CLKREF_CLK                       
176 #define GCC_HDMI_CLKREF_CLK                       
177 #define GCC_UFS_CLKREF_CLK                        
178 #define GCC_PCIE_CLKREF_CLK                       
179 #define GCC_RX1_USB2_CLKREF_CLK                   
180 #define GCC_MSS_CFG_AHB_CLK                       
181 #define GCC_BOOT_ROM_AHB_CLK                      
182 #define GCC_MSS_GPLL0_DIV_CLK_SRC                 
183 #define GCC_MSS_SNOC_AXI_CLK                      
184 #define GCC_MSS_MNOC_BIMC_AXI_CLK                 
185 #define GCC_BIMC_GFX_CLK                          
186 #define UFS_UNIPRO_CORE_CLK_SRC                   
187 #define GCC_MMSS_GPLL0_CLK                        
188 #define HMSS_GPLL0_CLK_SRC                        
189 #define GCC_IM_SLEEP                              
190 #define AGGRE2_SNOC_NORTH_AXI                     
191 #define SSC_XO                                    
192 #define SSC_CNOC_AHBS_CLK                         
193 #define GCC_MMSS_GPLL0_DIV_CLK                    
194 #define GCC_GPU_GPLL0_DIV_CLK                     
195 #define GCC_GPU_GPLL0_CLK                         
196                                                   
197 #define PCIE_0_GDSC                               
198 #define UFS_GDSC                                  
199 #define USB_30_GDSC                               
200                                                   
201 #define GCC_BLSP1_QUP1_BCR                        
202 #define GCC_BLSP1_QUP2_BCR                        
203 #define GCC_BLSP1_QUP3_BCR                        
204 #define GCC_BLSP1_QUP4_BCR                        
205 #define GCC_BLSP1_QUP5_BCR                        
206 #define GCC_BLSP1_QUP6_BCR                        
207 #define GCC_BLSP2_QUP1_BCR                        
208 #define GCC_BLSP2_QUP2_BCR                        
209 #define GCC_BLSP2_QUP3_BCR                        
210 #define GCC_BLSP2_QUP4_BCR                        
211 #define GCC_BLSP2_QUP5_BCR                        
212 #define GCC_BLSP2_QUP6_BCR                        
213 #define GCC_PCIE_0_BCR                            
214 #define GCC_PDM_BCR                               
215 #define GCC_SDCC2_BCR                             
216 #define GCC_SDCC4_BCR                             
217 #define GCC_TSIF_BCR                              
218 #define GCC_UFS_BCR                               
219 #define GCC_USB_30_BCR                            
220 #define GCC_SYSTEM_NOC_BCR                        
221 #define GCC_CONFIG_NOC_BCR                        
222 #define GCC_AHB2PHY_EAST_BCR                      
223 #define GCC_IMEM_BCR                              
224 #define GCC_PIMEM_BCR                             
225 #define GCC_MMSS_BCR                              
226 #define GCC_QDSS_BCR                              
227 #define GCC_WCSS_BCR                              
228 #define GCC_BLSP1_BCR                             
229 #define GCC_BLSP1_UART1_BCR                       
230 #define GCC_BLSP1_UART2_BCR                       
231 #define GCC_BLSP1_UART3_BCR                       
232 #define GCC_CM_PHY_REFGEN1_BCR                    
233 #define GCC_CM_PHY_REFGEN2_BCR                    
234 #define GCC_BLSP2_BCR                             
235 #define GCC_BLSP2_UART1_BCR                       
236 #define GCC_BLSP2_UART2_BCR                       
237 #define GCC_BLSP2_UART3_BCR                       
238 #define GCC_SRAM_SENSOR_BCR                       
239 #define GCC_PRNG_BCR                              
240 #define GCC_TSIF_0_RESET                          
241 #define GCC_TSIF_1_RESET                          
242 #define GCC_TCSR_BCR                              
243 #define GCC_BOOT_ROM_BCR                          
244 #define GCC_MSG_RAM_BCR                           
245 #define GCC_TLMM_BCR                              
246 #define GCC_MPM_BCR                               
247 #define GCC_SEC_CTRL_BCR                          
248 #define GCC_SPMI_BCR                              
249 #define GCC_SPDM_BCR                              
250 #define GCC_CE1_BCR                               
251 #define GCC_BIMC_BCR                              
252 #define GCC_SNOC_BUS_TIMEOUT0_BCR                 
253 #define GCC_SNOC_BUS_TIMEOUT1_BCR                 
254 #define GCC_SNOC_BUS_TIMEOUT3_BCR                 
255 #define GCC_SNOC_BUS_TIMEOUT_EXTREF_BCR           
256 #define GCC_PNOC_BUS_TIMEOUT0_BCR                 
257 #define GCC_CNOC_PERIPH_BUS_TIMEOUT1_BCR          
258 #define GCC_CNOC_PERIPH_BUS_TIMEOUT2_BCR          
259 #define GCC_CNOC_BUS_TIMEOUT0_BCR                 
260 #define GCC_CNOC_BUS_TIMEOUT1_BCR                 
261 #define GCC_CNOC_BUS_TIMEOUT2_BCR                 
262 #define GCC_CNOC_BUS_TIMEOUT3_BCR                 
263 #define GCC_CNOC_BUS_TIMEOUT4_BCR                 
264 #define GCC_CNOC_BUS_TIMEOUT5_BCR                 
265 #define GCC_CNOC_BUS_TIMEOUT6_BCR                 
266 #define GCC_CNOC_BUS_TIMEOUT7_BCR                 
267 #define GCC_APB2JTAG_BCR                          
268 #define GCC_RBCPR_CX_BCR                          
269 #define GCC_RBCPR_MX_BCR                          
270 #define GCC_USB3_PHY_BCR                          
271 #define GCC_USB3PHY_PHY_BCR                       
272 #define GCC_USB3_DP_PHY_BCR                       
273 #define GCC_SSC_BCR                               
274 #define GCC_SSC_RESET                             
275 #define GCC_USB_PHY_CFG_AHB2PHY_BCR               
276 #define GCC_PCIE_0_LINK_DOWN_BCR                  
277 #define GCC_PCIE_0_PHY_BCR                        
278 #define GCC_PCIE_0_NOCSR_COM_PHY_BCR              
279 #define GCC_PCIE_PHY_BCR                          
280 #define GCC_PCIE_PHY_NOCSR_COM_PHY_BCR            
281 #define GCC_PCIE_PHY_CFG_AHB_BCR                  
282 #define GCC_PCIE_PHY_COM_BCR                      
283 #define GCC_GPU_BCR                               
284 #define GCC_SPSS_BCR                              
285 #define GCC_OBT_ODT_BCR                           
286 #define GCC_VS_BCR                                
287 #define GCC_MSS_VS_RESET                          
288 #define GCC_GPU_VS_RESET                          
289 #define GCC_APC0_VS_RESET                         
290 #define GCC_APC1_VS_RESET                         
291 #define GCC_CNOC_BUS_TIMEOUT8_BCR                 
292 #define GCC_CNOC_BUS_TIMEOUT9_BCR                 
293 #define GCC_CNOC_BUS_TIMEOUT10_BCR                
294 #define GCC_CNOC_BUS_TIMEOUT11_BCR                
295 #define GCC_CNOC_BUS_TIMEOUT12_BCR                
296 #define GCC_CNOC_BUS_TIMEOUT13_BCR                
297 #define GCC_CNOC_BUS_TIMEOUT14_BCR                
298 #define GCC_CNOC_BUS_TIMEOUT_EXTREF_BCR           
299 #define GCC_AGGRE1_NOC_BCR                        
300 #define GCC_AGGRE2_NOC_BCR                        
301 #define GCC_DCC_BCR                               
302 #define GCC_QREFS_VBG_CAL_BCR                     
303 #define GCC_IPA_BCR                               
304 #define GCC_GLM_BCR                               
305 #define GCC_SKL_BCR                               
306 #define GCC_MSMPU_BCR                             
307 #define GCC_QUSB2PHY_PRIM_BCR                     
308 #define GCC_QUSB2PHY_SEC_BCR                      
309 #define GCC_MSS_RESTART                           
310                                                   
311 #endif                                            
312                                                   

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