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All rights reserved. 4 */ 4 */ 5 5 6 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_SDX65_H 6 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_SDX65_H 7 #define _DT_BINDINGS_CLK_QCOM_GCC_SDX65_H 7 #define _DT_BINDINGS_CLK_QCOM_GCC_SDX65_H 8 8 9 /* GCC clocks */ 9 /* GCC clocks */ 10 #define GPLL0 10 #define GPLL0 0 11 #define GPLL0_OUT_EVEN 11 #define GPLL0_OUT_EVEN 1 12 #define GCC_AHB_PCIE_LINK_CLK 12 #define GCC_AHB_PCIE_LINK_CLK 2 13 #define GCC_BLSP1_AHB_CLK 13 #define GCC_BLSP1_AHB_CLK 3 14 #define GCC_BLSP1_QUP1_I2C_APPS_CLK 14 #define GCC_BLSP1_QUP1_I2C_APPS_CLK 4 15 #define GCC_BLSP1_QUP1_I2C_APPS_CLK_SRC 15 #define GCC_BLSP1_QUP1_I2C_APPS_CLK_SRC 5 16 #define GCC_BLSP1_QUP1_SPI_APPS_CLK 16 #define GCC_BLSP1_QUP1_SPI_APPS_CLK 6 17 #define GCC_BLSP1_QUP1_SPI_APPS_CLK_SRC 17 #define GCC_BLSP1_QUP1_SPI_APPS_CLK_SRC 7 18 #define GCC_BLSP1_QUP2_I2C_APPS_CLK 18 #define GCC_BLSP1_QUP2_I2C_APPS_CLK 8 19 #define GCC_BLSP1_QUP2_I2C_APPS_CLK_SRC 19 #define GCC_BLSP1_QUP2_I2C_APPS_CLK_SRC 9 20 #define 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