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TOMOYO Linux Cross Reference
Linux/include/dt-bindings/clock/qcom,gcc-sm8150.h

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Differences between /include/dt-bindings/clock/qcom,gcc-sm8150.h (Architecture i386) and /include/dt-bindings/clock/qcom,gcc-sm8150.h (Architecture m68k)


  1 /* SPDX-License-Identifier: GPL-2.0 */              1 /* SPDX-License-Identifier: GPL-2.0 */
  2 /*                                                  2 /*
  3  * Copyright (c) 2019, The Linux Foundation. A      3  * Copyright (c) 2019, The Linux Foundation. All rights reserved.
  4  */                                                 4  */
  5                                                     5 
  6 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_SM8150_H          6 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_SM8150_H
  7 #define _DT_BINDINGS_CLK_QCOM_GCC_SM8150_H          7 #define _DT_BINDINGS_CLK_QCOM_GCC_SM8150_H
  8                                                     8 
  9 /* GCC clocks */                                    9 /* GCC clocks */
 10 #define GCC_AGGRE_NOC_PCIE_TBU_CLK                 10 #define GCC_AGGRE_NOC_PCIE_TBU_CLK                              0
 11 #define GCC_AGGRE_UFS_CARD_AXI_CLK                 11 #define GCC_AGGRE_UFS_CARD_AXI_CLK                              1
 12 #define GCC_AGGRE_UFS_CARD_AXI_HW_CTL_CLK          12 #define GCC_AGGRE_UFS_CARD_AXI_HW_CTL_CLK                       2
 13 #define GCC_AGGRE_UFS_PHY_AXI_CLK                  13 #define GCC_AGGRE_UFS_PHY_AXI_CLK                               3
 14 #define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK           14 #define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK                        4
 15 #define GCC_AGGRE_USB3_PRIM_AXI_CLK                15 #define GCC_AGGRE_USB3_PRIM_AXI_CLK                             5
 16 #define GCC_AGGRE_USB3_SEC_AXI_CLK                 16 #define GCC_AGGRE_USB3_SEC_AXI_CLK                              6
 17 #define GCC_BOOT_ROM_AHB_CLK                       17 #define GCC_BOOT_ROM_AHB_CLK                                    7
 18 #define GCC_CAMERA_AHB_CLK                         18 #define GCC_CAMERA_AHB_CLK                                      8
 19 #define GCC_CAMERA_HF_AXI_CLK                      19 #define GCC_CAMERA_HF_AXI_CLK                                   9
 20 #define GCC_CAMERA_SF_AXI_CLK                      20 #define GCC_CAMERA_SF_AXI_CLK                                   10
 21 #define GCC_CAMERA_XO_CLK                          21 #define GCC_CAMERA_XO_CLK                                       11
 22 #define GCC_CFG_NOC_USB3_PRIM_AXI_CLK              22 #define GCC_CFG_NOC_USB3_PRIM_AXI_CLK                           12
 23 #define GCC_CFG_NOC_USB3_SEC_AXI_CLK               23 #define GCC_CFG_NOC_USB3_SEC_AXI_CLK                            13
 24 #define GCC_CPUSS_AHB_CLK                          24 #define GCC_CPUSS_AHB_CLK                                       14
 25 #define GCC_CPUSS_AHB_CLK_SRC                      25 #define GCC_CPUSS_AHB_CLK_SRC                                   15
 26 #define GCC_CPUSS_DVM_BUS_CLK                      26 #define GCC_CPUSS_DVM_BUS_CLK                                   16
 27 #define GCC_CPUSS_GNOC_CLK                         27 #define GCC_CPUSS_GNOC_CLK                                      17
 28 #define GCC_CPUSS_RBCPR_CLK                        28 #define GCC_CPUSS_RBCPR_CLK                                     18
 29 #define GCC_DDRSS_GPU_AXI_CLK                      29 #define GCC_DDRSS_GPU_AXI_CLK                                   19
 30 #define GCC_DISP_AHB_CLK                           30 #define GCC_DISP_AHB_CLK                                        20
 31 #define GCC_DISP_HF_AXI_CLK                        31 #define GCC_DISP_HF_AXI_CLK                                     21
 32 #define GCC_DISP_SF_AXI_CLK                        32 #define GCC_DISP_SF_AXI_CLK                                     22
 33 #define GCC_DISP_XO_CLK                            33 #define GCC_DISP_XO_CLK                                         23
 34 #define GCC_EMAC_AXI_CLK                           34 #define GCC_EMAC_AXI_CLK                                        24
 35 #define GCC_EMAC_PTP_CLK                           35 #define GCC_EMAC_PTP_CLK                                        25
 36 #define GCC_EMAC_PTP_CLK_SRC                       36 #define GCC_EMAC_PTP_CLK_SRC                                    26
 37 #define GCC_EMAC_RGMII_CLK                         37 #define GCC_EMAC_RGMII_CLK                                      27
 38 #define GCC_EMAC_RGMII_CLK_SRC                     38 #define GCC_EMAC_RGMII_CLK_SRC                                  28
 39 #define GCC_EMAC_SLV_AHB_CLK                       39 #define GCC_EMAC_SLV_AHB_CLK                                    29
 40 #define GCC_GP1_CLK                                40 #define GCC_GP1_CLK                                             30
 41 #define GCC_GP1_CLK_SRC                            41 #define GCC_GP1_CLK_SRC                                         31
 42 #define GCC_GP2_CLK                                42 #define GCC_GP2_CLK                                             32
 43 #define GCC_GP2_CLK_SRC                            43 #define GCC_GP2_CLK_SRC                                         33
 44 #define GCC_GP3_CLK                                44 #define GCC_GP3_CLK                                             34
 45 #define GCC_GP3_CLK_SRC                            45 #define GCC_GP3_CLK_SRC                                         35
 46 #define GCC_GPU_CFG_AHB_CLK                        46 #define GCC_GPU_CFG_AHB_CLK                                     36
 47 #define GCC_GPU_GPLL0_CLK_SRC                      47 #define GCC_GPU_GPLL0_CLK_SRC                                   37
 48 #define GCC_GPU_GPLL0_DIV_CLK_SRC                  48 #define GCC_GPU_GPLL0_DIV_CLK_SRC                               38
 49 #define GCC_GPU_IREF_CLK                           49 #define GCC_GPU_IREF_CLK                                        39
 50 #define GCC_GPU_MEMNOC_GFX_CLK                     50 #define GCC_GPU_MEMNOC_GFX_CLK                                  40
 51 #define GCC_GPU_SNOC_DVM_GFX_CLK                   51 #define GCC_GPU_SNOC_DVM_GFX_CLK                                41
 52 #define GCC_NPU_AT_CLK                             52 #define GCC_NPU_AT_CLK                                          42
 53 #define GCC_NPU_AXI_CLK                            53 #define GCC_NPU_AXI_CLK                                         43
 54 #define GCC_NPU_CFG_AHB_CLK                        54 #define GCC_NPU_CFG_AHB_CLK                                     44
 55 #define GCC_NPU_GPLL0_CLK_SRC                      55 #define GCC_NPU_GPLL0_CLK_SRC                                   45
 56 #define GCC_NPU_GPLL0_DIV_CLK_SRC                  56 #define GCC_NPU_GPLL0_DIV_CLK_SRC                               46
 57 #define GCC_NPU_TRIG_CLK                           57 #define GCC_NPU_TRIG_CLK                                        47
 58 #define GCC_PCIE0_PHY_REFGEN_CLK                   58 #define GCC_PCIE0_PHY_REFGEN_CLK                                48
 59 #define GCC_PCIE1_PHY_REFGEN_CLK                   59 #define GCC_PCIE1_PHY_REFGEN_CLK                                49
 60 #define GCC_PCIE_0_AUX_CLK                         60 #define GCC_PCIE_0_AUX_CLK                                      50
 61 #define GCC_PCIE_0_AUX_CLK_SRC                     61 #define GCC_PCIE_0_AUX_CLK_SRC                                  51
 62 #define GCC_PCIE_0_CFG_AHB_CLK                     62 #define GCC_PCIE_0_CFG_AHB_CLK                                  52
 63 #define GCC_PCIE_0_CLKREF_CLK                      63 #define GCC_PCIE_0_CLKREF_CLK                                   53
 64 #define GCC_PCIE_0_MSTR_AXI_CLK                    64 #define GCC_PCIE_0_MSTR_AXI_CLK                                 54
 65 #define GCC_PCIE_0_PIPE_CLK                        65 #define GCC_PCIE_0_PIPE_CLK                                     55
 66 #define GCC_PCIE_0_SLV_AXI_CLK                     66 #define GCC_PCIE_0_SLV_AXI_CLK                                  56
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 69 #define GCC_PCIE_1_AUX_CLK_SRC                     69 #define GCC_PCIE_1_AUX_CLK_SRC                                  59
 70 #define GCC_PCIE_1_CFG_AHB_CLK                     70 #define GCC_PCIE_1_CFG_AHB_CLK                                  60
 71 #define GCC_PCIE_1_CLKREF_CLK                      71 #define GCC_PCIE_1_CLKREF_CLK                                   61
 72 #define GCC_PCIE_1_MSTR_AXI_CLK                    72 #define GCC_PCIE_1_MSTR_AXI_CLK                                 62
 73 #define GCC_PCIE_1_PIPE_CLK                        73 #define GCC_PCIE_1_PIPE_CLK                                     63
 74 #define GCC_PCIE_1_SLV_AXI_CLK                     74 #define GCC_PCIE_1_SLV_AXI_CLK                                  64
 75 #define GCC_PCIE_1_SLV_Q2A_AXI_CLK                 75 #define GCC_PCIE_1_SLV_Q2A_AXI_CLK                              65
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 77 #define GCC_PCIE_PHY_REFGEN_CLK_SRC                77 #define GCC_PCIE_PHY_REFGEN_CLK_SRC                             67
 78 #define GCC_PDM2_CLK                               78 #define GCC_PDM2_CLK                                            68
 79 #define GCC_PDM2_CLK_SRC                           79 #define GCC_PDM2_CLK_SRC                                        69
 80 #define GCC_PDM_AHB_CLK                            80 #define GCC_PDM_AHB_CLK                                         70
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170 #define GCC_UFS_PHY_ICE_CORE_CLK                  170 #define GCC_UFS_PHY_ICE_CORE_CLK                                160
171 #define GCC_UFS_PHY_ICE_CORE_CLK_SRC              171 #define GCC_UFS_PHY_ICE_CORE_CLK_SRC                            161
172 #define GCC_UFS_PHY_ICE_CORE_HW_CTL_CLK           172 #define GCC_UFS_PHY_ICE_CORE_HW_CTL_CLK                         162
173 #define GCC_UFS_PHY_PHY_AUX_CLK                   173 #define GCC_UFS_PHY_PHY_AUX_CLK                                 163
174 #define GCC_UFS_PHY_PHY_AUX_CLK_SRC               174 #define GCC_UFS_PHY_PHY_AUX_CLK_SRC                             164
175 #define GCC_UFS_PHY_PHY_AUX_HW_CTL_CLK            175 #define GCC_UFS_PHY_PHY_AUX_HW_CTL_CLK                          165
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180 #define GCC_UFS_PHY_UNIPRO_CORE_CLK_SRC           180 #define GCC_UFS_PHY_UNIPRO_CORE_CLK_SRC                         170
181 #define GCC_UFS_PHY_UNIPRO_CORE_HW_CTL_CLK        181 #define GCC_UFS_PHY_UNIPRO_CORE_HW_CTL_CLK                      171
182 #define GCC_USB30_PRIM_MASTER_CLK                 182 #define GCC_USB30_PRIM_MASTER_CLK                               172
183 #define GCC_USB30_PRIM_MASTER_CLK_SRC             183 #define GCC_USB30_PRIM_MASTER_CLK_SRC                           173
184 #define GCC_USB30_PRIM_MOCK_UTMI_CLK              184 #define GCC_USB30_PRIM_MOCK_UTMI_CLK                            174
185 #define GCC_USB30_PRIM_MOCK_UTMI_CLK_SRC          185 #define GCC_USB30_PRIM_MOCK_UTMI_CLK_SRC                        175
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198 #define GCC_USB3_SEC_PHY_AUX_CLK                  198 #define GCC_USB3_SEC_PHY_AUX_CLK                                188
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201 #define GCC_USB3_SEC_PHY_PIPE_CLK                 201 #define GCC_USB3_SEC_PHY_PIPE_CLK                               191
202 #define GCC_VIDEO_AHB_CLK                         202 #define GCC_VIDEO_AHB_CLK                                       192
203 #define GCC_VIDEO_AXI0_CLK                        203 #define GCC_VIDEO_AXI0_CLK                                      193
204 #define GCC_VIDEO_AXI1_CLK                        204 #define GCC_VIDEO_AXI1_CLK                                      194
205 #define GCC_VIDEO_AXIC_CLK                        205 #define GCC_VIDEO_AXIC_CLK                                      195
206 #define GCC_VIDEO_XO_CLK                          206 #define GCC_VIDEO_XO_CLK                                        196
207 #define GPLL0                                     207 #define GPLL0                                                   197
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212 /* Reset clocks */                                212 /* Reset clocks */
213 #define GCC_EMAC_BCR                              213 #define GCC_EMAC_BCR                                            0
214 #define GCC_GPU_BCR                               214 #define GCC_GPU_BCR                                             1
215 #define GCC_MMSS_BCR                              215 #define GCC_MMSS_BCR                                            2
216 #define GCC_NPU_BCR                               216 #define GCC_NPU_BCR                                             3
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224 #define GCC_QSPI_BCR                              224 #define GCC_QSPI_BCR                                            11
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228 #define GCC_QUSB2PHY_PRIM_BCR                     228 #define GCC_QUSB2PHY_PRIM_BCR                                   15
229 #define GCC_QUSB2PHY_SEC_BCR                      229 #define GCC_QUSB2PHY_SEC_BCR                                    16
230 #define GCC_USB3_PHY_PRIM_BCR                     230 #define GCC_USB3_PHY_PRIM_BCR                                   17
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235 #define GCC_SDCC4_BCR                             235 #define GCC_SDCC4_BCR                                           22
236 #define GCC_TSIF_BCR                              236 #define GCC_TSIF_BCR                                            23
237 #define GCC_UFS_CARD_BCR                          237 #define GCC_UFS_CARD_BCR                                        24
238 #define GCC_UFS_PHY_BCR                           238 #define GCC_UFS_PHY_BCR                                         25
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240 #define GCC_USB30_SEC_BCR                         240 #define GCC_USB30_SEC_BCR                                       27
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242 #define GCC_VIDEO_AXIC_CLK_BCR                    242 #define GCC_VIDEO_AXIC_CLK_BCR                                  29
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247 #define PCIE_0_GDSC                               247 #define PCIE_0_GDSC                                             0
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256                                                   256 

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