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TOMOYO Linux Cross Reference
Linux/include/dt-bindings/clock/qcom,sm8650-gcc.h

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Diff markup

Differences between /include/dt-bindings/clock/qcom,sm8650-gcc.h (Architecture m68k) and /include/dt-bindings/clock/qcom,sm8650-gcc.h (Architecture i386)


  1 /* SPDX-License-Identifier: (GPL-2.0-only OR B      1 /* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
  2 /*                                                  2 /*
  3  * Copyright (c) 2022, Qualcomm Innovation Cen      3  * Copyright (c) 2022, Qualcomm Innovation Center, Inc. All rights reserved.
  4  * Copyright (c) 2023, Linaro Limited               4  * Copyright (c) 2023, Linaro Limited
  5  */                                                 5  */
  6                                                     6 
  7 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_SM8650_H          7 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_SM8650_H
  8 #define _DT_BINDINGS_CLK_QCOM_GCC_SM8650_H          8 #define _DT_BINDINGS_CLK_QCOM_GCC_SM8650_H
  9                                                     9 
 10 /* GCC clocks */                                   10 /* GCC clocks */
 11 #define GCC_AGGRE_NOC_PCIE_AXI_CLK                 11 #define GCC_AGGRE_NOC_PCIE_AXI_CLK                              0
 12 #define GCC_AGGRE_UFS_PHY_AXI_CLK                  12 #define GCC_AGGRE_UFS_PHY_AXI_CLK                               1
 13 #define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK           13 #define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK                        2
 14 #define GCC_AGGRE_USB3_PRIM_AXI_CLK                14 #define GCC_AGGRE_USB3_PRIM_AXI_CLK                             3
 15 #define GCC_BOOT_ROM_AHB_CLK                       15 #define GCC_BOOT_ROM_AHB_CLK                                    4
 16 #define GCC_CAMERA_AHB_CLK                         16 #define GCC_CAMERA_AHB_CLK                                      5
 17 #define GCC_CAMERA_HF_AXI_CLK                      17 #define GCC_CAMERA_HF_AXI_CLK                                   6
 18 #define GCC_CAMERA_SF_AXI_CLK                      18 #define GCC_CAMERA_SF_AXI_CLK                                   7
 19 #define GCC_CAMERA_XO_CLK                          19 #define GCC_CAMERA_XO_CLK                                       8
 20 #define GCC_CFG_NOC_PCIE_ANOC_AHB_CLK              20 #define GCC_CFG_NOC_PCIE_ANOC_AHB_CLK                           9
 21 #define GCC_CFG_NOC_USB3_PRIM_AXI_CLK              21 #define GCC_CFG_NOC_USB3_PRIM_AXI_CLK                           10
 22 #define GCC_CNOC_PCIE_SF_AXI_CLK                   22 #define GCC_CNOC_PCIE_SF_AXI_CLK                                11
 23 #define GCC_DDRSS_GPU_AXI_CLK                      23 #define GCC_DDRSS_GPU_AXI_CLK                                   12
 24 #define GCC_DDRSS_PCIE_SF_QTB_CLK                  24 #define GCC_DDRSS_PCIE_SF_QTB_CLK                               13
 25 #define GCC_DISP_AHB_CLK                           25 #define GCC_DISP_AHB_CLK                                        14
 26 #define GCC_DISP_HF_AXI_CLK                        26 #define GCC_DISP_HF_AXI_CLK                                     15
 27 #define GCC_DISP_XO_CLK                            27 #define GCC_DISP_XO_CLK                                         16
 28 #define GCC_GP1_CLK                                28 #define GCC_GP1_CLK                                             17
 29 #define GCC_GP1_CLK_SRC                            29 #define GCC_GP1_CLK_SRC                                         18
 30 #define GCC_GP2_CLK                                30 #define GCC_GP2_CLK                                             19
 31 #define GCC_GP2_CLK_SRC                            31 #define GCC_GP2_CLK_SRC                                         20
 32 #define GCC_GP3_CLK                                32 #define GCC_GP3_CLK                                             21
 33 #define GCC_GP3_CLK_SRC                            33 #define GCC_GP3_CLK_SRC                                         22
 34 #define GCC_GPLL0                                  34 #define GCC_GPLL0                                               23
 35 #define GCC_GPLL0_OUT_EVEN                         35 #define GCC_GPLL0_OUT_EVEN                                      24
 36 #define GCC_GPLL1                                  36 #define GCC_GPLL1                                               25
 37 #define GCC_GPLL3                                  37 #define GCC_GPLL3                                               26
 38 #define GCC_GPLL4                                  38 #define GCC_GPLL4                                               27
 39 #define GCC_GPLL6                                  39 #define GCC_GPLL6                                               28
 40 #define GCC_GPLL7                                  40 #define GCC_GPLL7                                               29
 41 #define GCC_GPLL9                                  41 #define GCC_GPLL9                                               30
 42 #define GCC_GPU_CFG_AHB_CLK                        42 #define GCC_GPU_CFG_AHB_CLK                                     31
 43 #define GCC_GPU_GPLL0_CLK_SRC                      43 #define GCC_GPU_GPLL0_CLK_SRC                                   32
 44 #define GCC_GPU_GPLL0_DIV_CLK_SRC                  44 #define GCC_GPU_GPLL0_DIV_CLK_SRC                               33
 45 #define GCC_GPU_MEMNOC_GFX_CLK                     45 #define GCC_GPU_MEMNOC_GFX_CLK                                  34
 46 #define GCC_GPU_SNOC_DVM_GFX_CLK                   46 #define GCC_GPU_SNOC_DVM_GFX_CLK                                35
 47 #define GCC_PCIE_0_AUX_CLK                         47 #define GCC_PCIE_0_AUX_CLK                                      36
 48 #define GCC_PCIE_0_AUX_CLK_SRC                     48 #define GCC_PCIE_0_AUX_CLK_SRC                                  37
 49 #define GCC_PCIE_0_CFG_AHB_CLK                     49 #define GCC_PCIE_0_CFG_AHB_CLK                                  38
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 51 #define GCC_PCIE_0_PHY_RCHNG_CLK                   51 #define GCC_PCIE_0_PHY_RCHNG_CLK                                40
 52 #define GCC_PCIE_0_PHY_RCHNG_CLK_SRC               52 #define GCC_PCIE_0_PHY_RCHNG_CLK_SRC                            41
 53 #define GCC_PCIE_0_PIPE_CLK                        53 #define GCC_PCIE_0_PIPE_CLK                                     42
 54 #define GCC_PCIE_0_PIPE_CLK_SRC                    54 #define GCC_PCIE_0_PIPE_CLK_SRC                                 43
 55 #define GCC_PCIE_0_SLV_AXI_CLK                     55 #define GCC_PCIE_0_SLV_AXI_CLK                                  44
 56 #define GCC_PCIE_0_SLV_Q2A_AXI_CLK                 56 #define GCC_PCIE_0_SLV_Q2A_AXI_CLK                              45
 57 #define GCC_PCIE_1_AUX_CLK                         57 #define GCC_PCIE_1_AUX_CLK                                      46
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 59 #define GCC_PCIE_1_CFG_AHB_CLK                     59 #define GCC_PCIE_1_CFG_AHB_CLK                                  48
 60 #define GCC_PCIE_1_MSTR_AXI_CLK                    60 #define GCC_PCIE_1_MSTR_AXI_CLK                                 49
 61 #define GCC_PCIE_1_PHY_AUX_CLK                     61 #define GCC_PCIE_1_PHY_AUX_CLK                                  50
 62 #define GCC_PCIE_1_PHY_AUX_CLK_SRC                 62 #define GCC_PCIE_1_PHY_AUX_CLK_SRC                              51
 63 #define GCC_PCIE_1_PHY_RCHNG_CLK                   63 #define GCC_PCIE_1_PHY_RCHNG_CLK                                52
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 65 #define GCC_PCIE_1_PIPE_CLK                        65 #define GCC_PCIE_1_PIPE_CLK                                     54
 66 #define GCC_PCIE_1_PIPE_CLK_SRC                    66 #define GCC_PCIE_1_PIPE_CLK_SRC                                 55
 67 #define GCC_PCIE_1_SLV_AXI_CLK                     67 #define GCC_PCIE_1_SLV_AXI_CLK                                  56
 68 #define GCC_PCIE_1_SLV_Q2A_AXI_CLK                 68 #define GCC_PCIE_1_SLV_Q2A_AXI_CLK                              57
 69 #define GCC_PDM2_CLK                               69 #define GCC_PDM2_CLK                                            58
 70 #define GCC_PDM2_CLK_SRC                           70 #define GCC_PDM2_CLK_SRC                                        59
 71 #define GCC_PDM_AHB_CLK                            71 #define GCC_PDM_AHB_CLK                                         60
 72 #define GCC_PDM_XO4_CLK                            72 #define GCC_PDM_XO4_CLK                                         61
 73 #define GCC_QMIP_CAMERA_NRT_AHB_CLK                73 #define GCC_QMIP_CAMERA_NRT_AHB_CLK                             62
 74 #define GCC_QMIP_CAMERA_RT_AHB_CLK                 74 #define GCC_QMIP_CAMERA_RT_AHB_CLK                              63
 75 #define GCC_QMIP_DISP_AHB_CLK                      75 #define GCC_QMIP_DISP_AHB_CLK                                   64
 76 #define GCC_QMIP_GPU_AHB_CLK                       76 #define GCC_QMIP_GPU_AHB_CLK                                    65
 77 #define GCC_QMIP_PCIE_AHB_CLK                      77 #define GCC_QMIP_PCIE_AHB_CLK                                   66
 78 #define GCC_QMIP_VIDEO_CV_CPU_AHB_CLK              78 #define GCC_QMIP_VIDEO_CV_CPU_AHB_CLK                           67
 79 #define GCC_QMIP_VIDEO_CVP_AHB_CLK                 79 #define GCC_QMIP_VIDEO_CVP_AHB_CLK                              68
 80 #define GCC_QMIP_VIDEO_V_CPU_AHB_CLK               80 #define GCC_QMIP_VIDEO_V_CPU_AHB_CLK                            69
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168 #define GCC_UFS_PHY_AXI_HW_CTL_CLK                168 #define GCC_UFS_PHY_AXI_HW_CTL_CLK                              157
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170 #define GCC_UFS_PHY_ICE_CORE_CLK_SRC              170 #define GCC_UFS_PHY_ICE_CORE_CLK_SRC                            159
171 #define GCC_UFS_PHY_ICE_CORE_HW_CTL_CLK           171 #define GCC_UFS_PHY_ICE_CORE_HW_CTL_CLK                         160
172 #define GCC_UFS_PHY_PHY_AUX_CLK                   172 #define GCC_UFS_PHY_PHY_AUX_CLK                                 161
173 #define GCC_UFS_PHY_PHY_AUX_CLK_SRC               173 #define GCC_UFS_PHY_PHY_AUX_CLK_SRC                             162
174 #define GCC_UFS_PHY_PHY_AUX_HW_CTL_CLK            174 #define GCC_UFS_PHY_PHY_AUX_HW_CTL_CLK                          163
175 #define GCC_UFS_PHY_RX_SYMBOL_0_CLK               175 #define GCC_UFS_PHY_RX_SYMBOL_0_CLK                             164
176 #define GCC_UFS_PHY_RX_SYMBOL_0_CLK_SRC           176 #define GCC_UFS_PHY_RX_SYMBOL_0_CLK_SRC                         165
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180 #define GCC_UFS_PHY_TX_SYMBOL_0_CLK_SRC           180 #define GCC_UFS_PHY_TX_SYMBOL_0_CLK_SRC                         169
181 #define GCC_UFS_PHY_UNIPRO_CORE_CLK               181 #define GCC_UFS_PHY_UNIPRO_CORE_CLK                             170
182 #define GCC_UFS_PHY_UNIPRO_CORE_CLK_SRC           182 #define GCC_UFS_PHY_UNIPRO_CORE_CLK_SRC                         171
183 #define GCC_UFS_PHY_UNIPRO_CORE_HW_CTL_CLK        183 #define GCC_UFS_PHY_UNIPRO_CORE_HW_CTL_CLK                      172
184 #define GCC_USB30_PRIM_MASTER_CLK                 184 #define GCC_USB30_PRIM_MASTER_CLK                               173
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187 #define GCC_USB30_PRIM_MOCK_UTMI_CLK_SRC          187 #define GCC_USB30_PRIM_MOCK_UTMI_CLK_SRC                        176
188 #define GCC_USB30_PRIM_MOCK_UTMI_POSTDIV_CLK_S    188 #define GCC_USB30_PRIM_MOCK_UTMI_POSTDIV_CLK_SRC                177
189 #define GCC_USB30_PRIM_SLEEP_CLK                  189 #define GCC_USB30_PRIM_SLEEP_CLK                                178
190 #define GCC_USB3_PRIM_PHY_AUX_CLK                 190 #define GCC_USB3_PRIM_PHY_AUX_CLK                               179
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194 #define GCC_USB3_PRIM_PHY_PIPE_CLK_SRC            194 #define GCC_USB3_PRIM_PHY_PIPE_CLK_SRC                          183
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198 #define GCC_VIDEO_XO_CLK                          198 #define GCC_VIDEO_XO_CLK                                        187
199 #define GCC_GPLL0_AO                              199 #define GCC_GPLL0_AO                                            188
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201 #define GCC_GPLL1_AO                              201 #define GCC_GPLL1_AO                                            190
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205                                                   205 
206 /* GCC resets */                                  206 /* GCC resets */
207 #define GCC_CAMERA_BCR                            207 #define GCC_CAMERA_BCR                                          0
208 #define GCC_DISPLAY_BCR                           208 #define GCC_DISPLAY_BCR                                         1
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211 #define GCC_PCIE_0_LINK_DOWN_BCR                  211 #define GCC_PCIE_0_LINK_DOWN_BCR                                4
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229 #define GCC_QUSB2PHY_SEC_BCR                      229 #define GCC_QUSB2PHY_SEC_BCR                                    22
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255                                                   255 

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