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TOMOYO Linux Cross Reference
Linux/include/dt-bindings/clock/qcom,x1e80100-gcc.h

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Differences between /include/dt-bindings/clock/qcom,x1e80100-gcc.h (Architecture sparc64) and /include/dt-bindings/clock/qcom,x1e80100-gcc.h (Architecture sparc)


  1 /* SPDX-License-Identifier: (GPL-2.0-only OR B      1 /* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
  2 /*                                                  2 /*
  3  * Copyright (c) 2023, Qualcomm Innovation Cen      3  * Copyright (c) 2023, Qualcomm Innovation Center, Inc. All rights reserved.
  4  */                                                 4  */
  5                                                     5 
  6 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_X1E80100_H        6 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_X1E80100_H
  7 #define _DT_BINDINGS_CLK_QCOM_GCC_X1E80100_H        7 #define _DT_BINDINGS_CLK_QCOM_GCC_X1E80100_H
  8                                                     8 
  9 /* GCC clocks */                                    9 /* GCC clocks */
 10 #define GCC_AGGRE_NOC_USB_NORTH_AXI_CLK            10 #define GCC_AGGRE_NOC_USB_NORTH_AXI_CLK                         0
 11 #define GCC_AGGRE_NOC_USB_SOUTH_AXI_CLK            11 #define GCC_AGGRE_NOC_USB_SOUTH_AXI_CLK                         1
 12 #define GCC_AGGRE_UFS_PHY_AXI_CLK                  12 #define GCC_AGGRE_UFS_PHY_AXI_CLK                               2
 13 #define GCC_AGGRE_USB2_PRIM_AXI_CLK                13 #define GCC_AGGRE_USB2_PRIM_AXI_CLK                             3
 14 #define GCC_AGGRE_USB3_MP_AXI_CLK                  14 #define GCC_AGGRE_USB3_MP_AXI_CLK                               4
 15 #define GCC_AGGRE_USB3_PRIM_AXI_CLK                15 #define GCC_AGGRE_USB3_PRIM_AXI_CLK                             5
 16 #define GCC_AGGRE_USB3_SEC_AXI_CLK                 16 #define GCC_AGGRE_USB3_SEC_AXI_CLK                              6
 17 #define GCC_AGGRE_USB3_TERT_AXI_CLK                17 #define GCC_AGGRE_USB3_TERT_AXI_CLK                             7
 18 #define GCC_AGGRE_USB4_0_AXI_CLK                   18 #define GCC_AGGRE_USB4_0_AXI_CLK                                8
 19 #define GCC_AGGRE_USB4_1_AXI_CLK                   19 #define GCC_AGGRE_USB4_1_AXI_CLK                                9
 20 #define GCC_AGGRE_USB4_2_AXI_CLK                   20 #define GCC_AGGRE_USB4_2_AXI_CLK                                10
 21 #define GCC_AGGRE_USB_NOC_AXI_CLK                  21 #define GCC_AGGRE_USB_NOC_AXI_CLK                               11
 22 #define GCC_AV1E_AHB_CLK                           22 #define GCC_AV1E_AHB_CLK                                        12
 23 #define GCC_AV1E_AXI_CLK                           23 #define GCC_AV1E_AXI_CLK                                        13
 24 #define GCC_AV1E_XO_CLK                            24 #define GCC_AV1E_XO_CLK                                         14
 25 #define GCC_BOOT_ROM_AHB_CLK                       25 #define GCC_BOOT_ROM_AHB_CLK                                    15
 26 #define GCC_CAMERA_AHB_CLK                         26 #define GCC_CAMERA_AHB_CLK                                      16
 27 #define GCC_CAMERA_HF_AXI_CLK                      27 #define GCC_CAMERA_HF_AXI_CLK                                   17
 28 #define GCC_CAMERA_SF_AXI_CLK                      28 #define GCC_CAMERA_SF_AXI_CLK                                   18
 29 #define GCC_CAMERA_XO_CLK                          29 #define GCC_CAMERA_XO_CLK                                       19
 30 #define GCC_CFG_NOC_PCIE_ANOC_AHB_CLK              30 #define GCC_CFG_NOC_PCIE_ANOC_AHB_CLK                           20
 31 #define GCC_CFG_NOC_PCIE_ANOC_NORTH_AHB_CLK        31 #define GCC_CFG_NOC_PCIE_ANOC_NORTH_AHB_CLK                     21
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 33 #define GCC_CFG_NOC_USB2_PRIM_AXI_CLK              33 #define GCC_CFG_NOC_USB2_PRIM_AXI_CLK                           23
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 35 #define GCC_CFG_NOC_USB3_PRIM_AXI_CLK              35 #define GCC_CFG_NOC_USB3_PRIM_AXI_CLK                           25
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 39 #define GCC_CFG_NOC_USB_ANOC_NORTH_AHB_CLK         39 #define GCC_CFG_NOC_USB_ANOC_NORTH_AHB_CLK                      29
 40 #define GCC_CFG_NOC_USB_ANOC_SOUTH_AHB_CLK         40 #define GCC_CFG_NOC_USB_ANOC_SOUTH_AHB_CLK                      30
 41 #define GCC_CNOC_PCIE1_TUNNEL_CLK                  41 #define GCC_CNOC_PCIE1_TUNNEL_CLK                               31
 42 #define GCC_CNOC_PCIE2_TUNNEL_CLK                  42 #define GCC_CNOC_PCIE2_TUNNEL_CLK                               32
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 47 #define GCC_DISP_AHB_CLK                           47 #define GCC_DISP_AHB_CLK                                        37
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 49 #define GCC_DISP_XO_CLK                            49 #define GCC_DISP_XO_CLK                                         39
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 51 #define GCC_GP1_CLK_SRC                            51 #define GCC_GP1_CLK_SRC                                         41
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 53 #define GCC_GP2_CLK_SRC                            53 #define GCC_GP2_CLK_SRC                                         43
 54 #define GCC_GP3_CLK                                54 #define GCC_GP3_CLK                                             44
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 58 #define GCC_GPLL4                                  58 #define GCC_GPLL4                                               48
 59 #define GCC_GPLL7                                  59 #define GCC_GPLL7                                               49
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 61 #define GCC_GPLL9                                  61 #define GCC_GPLL9                                               51
 62 #define GCC_GPU_CFG_AHB_CLK                        62 #define GCC_GPU_CFG_AHB_CLK                                     52
 63 #define GCC_GPU_GPLL0_CPH_CLK_SRC                  63 #define GCC_GPU_GPLL0_CPH_CLK_SRC                               53
 64 #define GCC_GPU_GPLL0_DIV_CPH_CLK_SRC              64 #define GCC_GPU_GPLL0_DIV_CPH_CLK_SRC                           54
 65 #define GCC_GPU_MEMNOC_GFX_CLK                     65 #define GCC_GPU_MEMNOC_GFX_CLK                                  55
 66 #define GCC_GPU_SNOC_DVM_GFX_CLK                   66 #define GCC_GPU_SNOC_DVM_GFX_CLK                                56
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 68 #define GCC_PCIE1_PHY_RCHNG_CLK                    68 #define GCC_PCIE1_PHY_RCHNG_CLK                                 58
 69 #define GCC_PCIE2_PHY_RCHNG_CLK                    69 #define GCC_PCIE2_PHY_RCHNG_CLK                                 59
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 73 #define GCC_PCIE_0_MSTR_AXI_CLK                    73 #define GCC_PCIE_0_MSTR_AXI_CLK                                 63
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 75 #define GCC_PCIE_0_PIPE_CLK                        75 #define GCC_PCIE_0_PIPE_CLK                                     65
 76 #define GCC_PCIE_0_SLV_AXI_CLK                     76 #define GCC_PCIE_0_SLV_AXI_CLK                                  66
 77 #define GCC_PCIE_0_SLV_Q2A_AXI_CLK                 77 #define GCC_PCIE_0_SLV_Q2A_AXI_CLK                              67
 78 #define GCC_PCIE_1_AUX_CLK                         78 #define GCC_PCIE_1_AUX_CLK                                      68
 79 #define GCC_PCIE_1_AUX_CLK_SRC                     79 #define GCC_PCIE_1_AUX_CLK_SRC                                  69
 80 #define GCC_PCIE_1_CFG_AHB_CLK                     80 #define GCC_PCIE_1_CFG_AHB_CLK                                  70
 81 #define GCC_PCIE_1_MSTR_AXI_CLK                    81 #define GCC_PCIE_1_MSTR_AXI_CLK                                 71
 82 #define GCC_PCIE_1_PHY_RCHNG_CLK_SRC               82 #define GCC_PCIE_1_PHY_RCHNG_CLK_SRC                            72
 83 #define GCC_PCIE_1_PIPE_CLK                        83 #define GCC_PCIE_1_PIPE_CLK                                     73
 84 #define GCC_PCIE_1_SLV_AXI_CLK                     84 #define GCC_PCIE_1_SLV_AXI_CLK                                  74
 85 #define GCC_PCIE_1_SLV_Q2A_AXI_CLK                 85 #define GCC_PCIE_1_SLV_Q2A_AXI_CLK                              75
 86 #define GCC_PCIE_2_AUX_CLK                         86 #define GCC_PCIE_2_AUX_CLK                                      76
 87 #define GCC_PCIE_2_AUX_CLK_SRC                     87 #define GCC_PCIE_2_AUX_CLK_SRC                                  77
 88 #define GCC_PCIE_2_CFG_AHB_CLK                     88 #define GCC_PCIE_2_CFG_AHB_CLK                                  78
 89 #define GCC_PCIE_2_MSTR_AXI_CLK                    89 #define GCC_PCIE_2_MSTR_AXI_CLK                                 79
 90 #define GCC_PCIE_2_PHY_RCHNG_CLK_SRC               90 #define GCC_PCIE_2_PHY_RCHNG_CLK_SRC                            80
 91 #define GCC_PCIE_2_PIPE_CLK                        91 #define GCC_PCIE_2_PIPE_CLK                                     81
 92 #define GCC_PCIE_2_SLV_AXI_CLK                     92 #define GCC_PCIE_2_SLV_AXI_CLK                                  82
 93 #define GCC_PCIE_2_SLV_Q2A_AXI_CLK                 93 #define GCC_PCIE_2_SLV_Q2A_AXI_CLK                              83
 94 #define GCC_PCIE_3_AUX_CLK                         94 #define GCC_PCIE_3_AUX_CLK                                      84
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 98 #define GCC_PCIE_3_PHY_AUX_CLK                     98 #define GCC_PCIE_3_PHY_AUX_CLK                                  88
 99 #define GCC_PCIE_3_PHY_RCHNG_CLK                   99 #define GCC_PCIE_3_PHY_RCHNG_CLK                                89
100 #define GCC_PCIE_3_PHY_RCHNG_CLK_SRC              100 #define GCC_PCIE_3_PHY_RCHNG_CLK_SRC                            90
101 #define GCC_PCIE_3_PIPE_CLK                       101 #define GCC_PCIE_3_PIPE_CLK                                     91
102 #define GCC_PCIE_3_PIPE_DIV_CLK_SRC               102 #define GCC_PCIE_3_PIPE_DIV_CLK_SRC                             92
103 #define GCC_PCIE_3_PIPEDIV2_CLK                   103 #define GCC_PCIE_3_PIPEDIV2_CLK                                 93
104 #define GCC_PCIE_3_SLV_AXI_CLK                    104 #define GCC_PCIE_3_SLV_AXI_CLK                                  94
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135 #define GCC_PCIE_6A_PIPE_CLK                      135 #define GCC_PCIE_6A_PIPE_CLK                                    125
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149 #define GCC_PCIE_6B_PIPEDIV2_CLK                  149 #define GCC_PCIE_6B_PIPEDIV2_CLK                                139
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153 #define GCC_PCIE_RSCC_XO_CLK                      153 #define GCC_PCIE_RSCC_XO_CLK                                    143
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157 #define GCC_PDM_AHB_CLK                           157 #define GCC_PDM_AHB_CLK                                         147
158 #define GCC_PDM_XO4_CLK                           158 #define GCC_PDM_XO4_CLK                                         148
159 #define GCC_QMIP_AV1E_AHB_CLK                     159 #define GCC_QMIP_AV1E_AHB_CLK                                   149
160 #define GCC_QMIP_CAMERA_NRT_AHB_CLK               160 #define GCC_QMIP_CAMERA_NRT_AHB_CLK                             150
161 #define GCC_QMIP_CAMERA_RT_AHB_CLK                161 #define GCC_QMIP_CAMERA_RT_AHB_CLK                              151
162 #define GCC_QMIP_DISP_AHB_CLK                     162 #define GCC_QMIP_DISP_AHB_CLK                                   152
163 #define GCC_QMIP_GPU_AHB_CLK                      163 #define GCC_QMIP_GPU_AHB_CLK                                    153
164 #define GCC_QMIP_VIDEO_CV_CPU_AHB_CLK             164 #define GCC_QMIP_VIDEO_CV_CPU_AHB_CLK                           154
165 #define GCC_QMIP_VIDEO_CVP_AHB_CLK                165 #define GCC_QMIP_VIDEO_CVP_AHB_CLK                              155
166 #define GCC_QMIP_VIDEO_V_CPU_AHB_CLK              166 #define GCC_QMIP_VIDEO_V_CPU_AHB_CLK                            156
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344 #define GCC_USB4_2_PHY_PCIE_PIPE_CLK              344 #define GCC_USB4_2_PHY_PCIE_PIPE_CLK                            334
345 #define GCC_USB4_2_PHY_PCIE_PIPE_CLK_SRC          345 #define GCC_USB4_2_PHY_PCIE_PIPE_CLK_SRC                        335
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347 #define GCC_USB4_2_PHY_RX1_CLK                    347 #define GCC_USB4_2_PHY_RX1_CLK                                  337
348 #define GCC_USB4_2_PHY_USB_PIPE_CLK               348 #define GCC_USB4_2_PHY_USB_PIPE_CLK                             338
349 #define GCC_USB4_2_SB_IF_CLK                      349 #define GCC_USB4_2_SB_IF_CLK                                    339
350 #define GCC_USB4_2_SB_IF_CLK_SRC                  350 #define GCC_USB4_2_SB_IF_CLK_SRC                                340
351 #define GCC_USB4_2_SYS_CLK                        351 #define GCC_USB4_2_SYS_CLK                                      341
352 #define GCC_USB4_2_TMU_CLK                        352 #define GCC_USB4_2_TMU_CLK                                      342
353 #define GCC_USB4_2_TMU_CLK_SRC                    353 #define GCC_USB4_2_TMU_CLK_SRC                                  343
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355 #define GCC_VIDEO_AXI0_CLK                        355 #define GCC_VIDEO_AXI0_CLK                                      345
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360 #define GCC_PCIE_5_PIPE_CLK_SRC                   360 #define GCC_PCIE_5_PIPE_CLK_SRC                                 350
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363 #define GCC_USB3_PRIM_PHY_PIPE_CLK_SRC            363 #define GCC_USB3_PRIM_PHY_PIPE_CLK_SRC                          353
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365 #define GCC_USB3_TERT_PHY_PIPE_CLK_SRC            365 #define GCC_USB3_TERT_PHY_PIPE_CLK_SRC                          355
366                                                   366 
367 /* GCC power domains */                           367 /* GCC power domains */
368 #define GCC_PCIE_0_TUNNEL_GDSC                    368 #define GCC_PCIE_0_TUNNEL_GDSC                                  0
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380 #define GCC_UFS_MEM_PHY_GDSC                      380 #define GCC_UFS_MEM_PHY_GDSC                                    12
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384 #define GCC_USB30_PRIM_GDSC                       384 #define GCC_USB30_PRIM_GDSC                                     16
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390 #define GCC_USB4_1_GDSC                           390 #define GCC_USB4_1_GDSC                                         22
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395                                                   395 
396 /* GCC resets */                                  396 /* GCC resets */
397 #define GCC_AV1E_BCR                              397 #define GCC_AV1E_BCR                                            0
398 #define GCC_CAMERA_BCR                            398 #define GCC_CAMERA_BCR                                          1
399 #define GCC_DISPLAY_BCR                           399 #define GCC_DISPLAY_BCR                                         2
400 #define GCC_GPU_BCR                               400 #define GCC_GPU_BCR                                             3
401 #define GCC_PCIE_0_LINK_DOWN_BCR                  401 #define GCC_PCIE_0_LINK_DOWN_BCR                                4
402 #define GCC_PCIE_0_NOCSR_COM_PHY_BCR              402 #define GCC_PCIE_0_NOCSR_COM_PHY_BCR                            5
403 #define GCC_PCIE_0_PHY_BCR                        403 #define GCC_PCIE_0_PHY_BCR                                      6
404 #define GCC_PCIE_0_PHY_NOCSR_COM_PHY_BCR          404 #define GCC_PCIE_0_PHY_NOCSR_COM_PHY_BCR                        7
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414 #define GCC_PCIE_2_PHY_NOCSR_COM_PHY_BCR          414 #define GCC_PCIE_2_PHY_NOCSR_COM_PHY_BCR                        17
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419 #define GCC_PCIE_3_PHY_BCR                        419 #define GCC_PCIE_3_PHY_BCR                                      22
420 #define GCC_PCIE_3_PHY_NOCSR_COM_PHY_BCR          420 #define GCC_PCIE_3_PHY_NOCSR_COM_PHY_BCR                        23
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425 #define GCC_PCIE_4_PHY_NOCSR_COM_PHY_BCR          425 #define GCC_PCIE_4_PHY_NOCSR_COM_PHY_BCR                        28
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427 #define GCC_PCIE_5_LINK_DOWN_BCR                  427 #define GCC_PCIE_5_LINK_DOWN_BCR                                30
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