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TOMOYO Linux Cross Reference
Linux/include/dt-bindings/clock/samsung,exynosautov9.h

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Differences between /include/dt-bindings/clock/samsung,exynosautov9.h (Architecture mips) and /include/dt-bindings/clock/samsung,exynosautov9.h (Architecture sparc64)


  1 /* SPDX-License-Identifier: (GPL-2.0-only OR B      1 /* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
  2 /*                                                  2 /*
  3  * Copyright (c) 2022 Samsung Electronics Co.,      3  * Copyright (c) 2022 Samsung Electronics Co., Ltd.
  4  * Author: Chanho Park <chanho61.park@samsung.      4  * Author: Chanho Park <chanho61.park@samsung.com>
  5  *                                                  5  *
  6  * Device Tree binding constants for Exynos Au      6  * Device Tree binding constants for Exynos Auto V9 clock controller.
  7  */                                                 7  */
  8                                                     8 
  9 #ifndef _DT_BINDINGS_CLOCK_EXYNOSAUTOV9_H           9 #ifndef _DT_BINDINGS_CLOCK_EXYNOSAUTOV9_H
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 11                                                    11 
 12 /* CMU_TOP */                                      12 /* CMU_TOP */
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 19 /* MUX in CMU_TOP */                               19 /* MUX in CMU_TOP */
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119                                                   119 
120 /* GAT in CMU_TOP */                              120 /* GAT in CMU_TOP */
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168                                                   168 
169 /* CMU_BUSMC */                                   169 /* CMU_BUSMC */
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174                                                   174 
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182 /* CMU_DPUM */                                    182 /* CMU_DPUM */
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192                                                   192 
193 /* CMU_FSYS0 */                                   193 /* CMU_FSYS0 */
194 #define CLK_MOUT_FSYS0_BUS_USER         1         194 #define CLK_MOUT_FSYS0_BUS_USER         1
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209                                                   209 
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220 #define CLK_GOUT_FSYS0_PCIE_GEN3B_2L1_CLK         220 #define CLK_GOUT_FSYS0_PCIE_GEN3B_2L1_CLK               25
221                                                   221 
222 #define CLK_GOUT_FSYS0_PCIE_GEN3_4L_X2_REFCLK     222 #define CLK_GOUT_FSYS0_PCIE_GEN3_4L_X2_REFCLK           26
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233                                                   233 
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236                                                   236 
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242                                                   242 
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244                                                   244 
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353                                                   353 
354 /* CMU_PERIS */                                   354 /* CMU_PERIS */
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359                                                   359 
360 #endif /* _DT_BINDINGS_CLOCK_EXYNOSAUTOV9_H */    360 #endif /* _DT_BINDINGS_CLOCK_EXYNOSAUTOV9_H */
361                                                   361 

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