1 /* SPDX-License-Identifier: GPL-2.0 */ << 2 /* 1 /* 3 * This header provides constants for binding 2 * This header provides constants for binding nvidia,tegra186-gpio*. 4 * 3 * 5 * The first cell in Tegra's GPIO specifier is 4 * The first cell in Tegra's GPIO specifier is the GPIO ID. The macros below 6 * provide names for this. 5 * provide names for this. 7 * 6 * 8 * The second cell contains standard flag valu 7 * The second cell contains standard flag values specified in gpio.h. 9 */ 8 */ 10 9 11 #ifndef _DT_BINDINGS_GPIO_TEGRA186_GPIO_H !! 10 #ifndef _DT_BINDINGS_GPIO_TEGRA_GPIO_H 12 #define _DT_BINDINGS_GPIO_TEGRA186_GPIO_H !! 11 #define _DT_BINDINGS_GPIO_TEGRA_GPIO_H 13 12 14 #include <dt-bindings/gpio/gpio.h> 13 #include <dt-bindings/gpio/gpio.h> 15 14 16 /* GPIOs implemented by main GPIO controller * 15 /* GPIOs implemented by main GPIO controller */ 17 #define TEGRA186_MAIN_GPIO_PORT_A 0 !! 16 #define TEGRA_MAIN_GPIO_PORT_A 0 18 #define TEGRA186_MAIN_GPIO_PORT_B 1 !! 17 #define TEGRA_MAIN_GPIO_PORT_B 1 19 #define TEGRA186_MAIN_GPIO_PORT_C 2 !! 18 #define TEGRA_MAIN_GPIO_PORT_C 2 20 #define TEGRA186_MAIN_GPIO_PORT_D 3 !! 19 #define TEGRA_MAIN_GPIO_PORT_D 3 21 #define TEGRA186_MAIN_GPIO_PORT_E 4 !! 20 #define TEGRA_MAIN_GPIO_PORT_E 4 22 #define TEGRA186_MAIN_GPIO_PORT_F 5 !! 21 #define TEGRA_MAIN_GPIO_PORT_F 5 23 #define TEGRA186_MAIN_GPIO_PORT_G 6 !! 22 #define TEGRA_MAIN_GPIO_PORT_G 6 24 #define TEGRA186_MAIN_GPIO_PORT_H 7 !! 23 #define TEGRA_MAIN_GPIO_PORT_H 7 25 #define TEGRA186_MAIN_GPIO_PORT_I 8 !! 24 #define TEGRA_MAIN_GPIO_PORT_I 8 26 #define TEGRA186_MAIN_GPIO_PORT_J 9 !! 25 #define TEGRA_MAIN_GPIO_PORT_J 9 27 #define TEGRA186_MAIN_GPIO_PORT_K 10 !! 26 #define TEGRA_MAIN_GPIO_PORT_K 10 28 #define TEGRA186_MAIN_GPIO_PORT_L 11 !! 27 #define TEGRA_MAIN_GPIO_PORT_L 11 29 #define TEGRA186_MAIN_GPIO_PORT_M 12 !! 28 #define TEGRA_MAIN_GPIO_PORT_M 12 30 #define TEGRA186_MAIN_GPIO_PORT_N 13 !! 29 #define TEGRA_MAIN_GPIO_PORT_N 13 31 #define TEGRA186_MAIN_GPIO_PORT_O 14 !! 30 #define TEGRA_MAIN_GPIO_PORT_O 14 32 #define TEGRA186_MAIN_GPIO_PORT_P 15 !! 31 #define TEGRA_MAIN_GPIO_PORT_P 15 33 #define TEGRA186_MAIN_GPIO_PORT_Q 16 !! 32 #define TEGRA_MAIN_GPIO_PORT_Q 16 34 #define TEGRA186_MAIN_GPIO_PORT_R 17 !! 33 #define TEGRA_MAIN_GPIO_PORT_R 17 35 #define TEGRA186_MAIN_GPIO_PORT_T 18 !! 34 #define TEGRA_MAIN_GPIO_PORT_T 18 36 #define TEGRA186_MAIN_GPIO_PORT_X 19 !! 35 #define TEGRA_MAIN_GPIO_PORT_X 19 37 #define TEGRA186_MAIN_GPIO_PORT_Y 20 !! 36 #define TEGRA_MAIN_GPIO_PORT_Y 20 38 #define TEGRA186_MAIN_GPIO_PORT_BB 21 !! 37 #define TEGRA_MAIN_GPIO_PORT_BB 21 39 #define TEGRA186_MAIN_GPIO_PORT_CC 22 !! 38 #define TEGRA_MAIN_GPIO_PORT_CC 22 40 39 41 #define TEGRA186_MAIN_GPIO(port, offset) \ !! 40 #define TEGRA_MAIN_GPIO(port, offset) \ 42 ((TEGRA186_MAIN_GPIO_PORT_##port * 8) !! 41 ((TEGRA_MAIN_GPIO_PORT_##port * 8) + offset) 43 42 44 /* GPIOs implemented by AON GPIO controller */ 43 /* GPIOs implemented by AON GPIO controller */ 45 #define TEGRA186_AON_GPIO_PORT_S 0 !! 44 #define TEGRA_AON_GPIO_PORT_S 0 46 #define TEGRA186_AON_GPIO_PORT_U 1 !! 45 #define TEGRA_AON_GPIO_PORT_U 1 47 #define TEGRA186_AON_GPIO_PORT_V 2 !! 46 #define TEGRA_AON_GPIO_PORT_V 2 48 #define TEGRA186_AON_GPIO_PORT_W 3 !! 47 #define TEGRA_AON_GPIO_PORT_W 3 49 #define TEGRA186_AON_GPIO_PORT_Z 4 !! 48 #define TEGRA_AON_GPIO_PORT_Z 4 50 #define TEGRA186_AON_GPIO_PORT_AA 5 !! 49 #define TEGRA_AON_GPIO_PORT_AA 5 51 #define TEGRA186_AON_GPIO_PORT_EE 6 !! 50 #define TEGRA_AON_GPIO_PORT_EE 6 52 #define TEGRA186_AON_GPIO_PORT_FF 7 !! 51 #define TEGRA_AON_GPIO_PORT_FF 7 53 52 54 #define TEGRA186_AON_GPIO(port, offset) \ !! 53 #define TEGRA_AON_GPIO(port, offset) \ 55 ((TEGRA186_AON_GPIO_PORT_##port * 8) + !! 54 ((TEGRA_AON_GPIO_PORT_##port * 8) + offset) 56 55 57 #endif 56 #endif 58 57
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