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TOMOYO Linux Cross Reference
Linux/scripts/dtc/include-prefixes/dt-bindings/clock/qcom,gcc-msm8909.h

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Differences between /scripts/dtc/include-prefixes/dt-bindings/clock/qcom,gcc-msm8909.h (Architecture i386) and /scripts/dtc/include-prefixes/dt-bindings/clock/qcom,gcc-msm8909.h (Architecture sparc)


  1 /* SPDX-License-Identifier: (GPL-2.0-only OR B      1 /* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
  2 /*                                                  2 /*
  3  * Copyright (C) 2022 Kernkonzept GmbH.             3  * Copyright (C) 2022 Kernkonzept GmbH.
  4  */                                                 4  */
  5                                                     5 
  6 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_8909_H            6 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_8909_H
  7 #define _DT_BINDINGS_CLK_QCOM_GCC_8909_H            7 #define _DT_BINDINGS_CLK_QCOM_GCC_8909_H
  8                                                     8 
  9 /* PLLs */                                          9 /* PLLs */
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 19 /* RCGs */                                         19 /* RCGs */
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 59 #define SYSTEM_NOC_BFDCD_CLK_SRC                   59 #define SYSTEM_NOC_BFDCD_CLK_SRC                47
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 66 #define VCODEC0_CLK_SRC                            66 #define VCODEC0_CLK_SRC                         54
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 69                                                    69 
 70 /* Voteable Clocks */                              70 /* Voteable Clocks */
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 83 #define GCC_SMMU_CFG_CLK                           83 #define GCC_SMMU_CFG_CLK                        69
 84 #define GCC_VENUS_TBU_CLK                          84 #define GCC_VENUS_TBU_CLK                       70
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 86                                                    86 
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 97 #define GCC_BLSP1_QUP4_SPI_APPS_CLK                97 #define GCC_BLSP1_QUP4_SPI_APPS_CLK             81
 98 #define GCC_BLSP1_QUP5_I2C_APPS_CLK                98 #define GCC_BLSP1_QUP5_I2C_APPS_CLK             82
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100 #define GCC_BLSP1_QUP6_I2C_APPS_CLK               100 #define GCC_BLSP1_QUP6_I2C_APPS_CLK             84
101 #define GCC_BLSP1_QUP6_SPI_APPS_CLK               101 #define GCC_BLSP1_QUP6_SPI_APPS_CLK             85
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103 #define GCC_BLSP1_UART2_APPS_CLK                  103 #define GCC_BLSP1_UART2_APPS_CLK                87
104 #define GCC_CAMSS_AHB_CLK                         104 #define GCC_CAMSS_AHB_CLK                       88
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164                                                   164 
165 /* Resets */                                      165 /* Resets */
166 #define GCC_AUDIO_CORE_BCR                        166 #define GCC_AUDIO_CORE_BCR                      0
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170 #define GCC_BLSP1_QUP3_BCR                        170 #define GCC_BLSP1_QUP3_BCR                      4
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173 #define GCC_BLSP1_QUP6_BCR                        173 #define GCC_BLSP1_QUP6_BCR                      7
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195 #define GCC_MDSS_BCR                              195 #define GCC_MDSS_BCR                            29
196 #define GCC_OXILI_BCR                             196 #define GCC_OXILI_BCR                           30
197 #define GCC_PDM_BCR                               197 #define GCC_PDM_BCR                             31
198 #define GCC_PRNG_BCR                              198 #define GCC_PRNG_BCR                            32
199 #define GCC_QUSB2_PHY_BCR                         199 #define GCC_QUSB2_PHY_BCR                       33
200 #define GCC_SDCC1_BCR                             200 #define GCC_SDCC1_BCR                           34
201 #define GCC_SDCC2_BCR                             201 #define GCC_SDCC2_BCR                           35
202 #define GCC_ULT_AUDIO_BCR                         202 #define GCC_ULT_AUDIO_BCR                       36
203 #define GCC_USB2A_PHY_BCR                         203 #define GCC_USB2A_PHY_BCR                       37
204 #define GCC_USB2_HS_PHY_ONLY_BCR                  204 #define GCC_USB2_HS_PHY_ONLY_BCR                38
205 #define GCC_USB_HS_BCR                            205 #define GCC_USB_HS_BCR                          39
206 #define GCC_VENUS0_BCR                            206 #define GCC_VENUS0_BCR                          40
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208 /* Subsystem Restart */                           208 /* Subsystem Restart */
209 #define GCC_MSS_RESTART                           209 #define GCC_MSS_RESTART                         41
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212 #define MDSS_GDSC                                 212 #define MDSS_GDSC                               0
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219                                                   219 

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