~ [ source navigation ] ~ [ diff markup ] ~ [ identifier search ] ~

TOMOYO Linux Cross Reference
Linux/scripts/dtc/include-prefixes/dt-bindings/reset/qcom,gcc-ipq6018.h

Version: ~ [ linux-6.12-rc7 ] ~ [ linux-6.11.7 ] ~ [ linux-6.10.14 ] ~ [ linux-6.9.12 ] ~ [ linux-6.8.12 ] ~ [ linux-6.7.12 ] ~ [ linux-6.6.60 ] ~ [ linux-6.5.13 ] ~ [ linux-6.4.16 ] ~ [ linux-6.3.13 ] ~ [ linux-6.2.16 ] ~ [ linux-6.1.116 ] ~ [ linux-6.0.19 ] ~ [ linux-5.19.17 ] ~ [ linux-5.18.19 ] ~ [ linux-5.17.15 ] ~ [ linux-5.16.20 ] ~ [ linux-5.15.171 ] ~ [ linux-5.14.21 ] ~ [ linux-5.13.19 ] ~ [ linux-5.12.19 ] ~ [ linux-5.11.22 ] ~ [ linux-5.10.229 ] ~ [ linux-5.9.16 ] ~ [ linux-5.8.18 ] ~ [ linux-5.7.19 ] ~ [ linux-5.6.19 ] ~ [ linux-5.5.19 ] ~ [ linux-5.4.285 ] ~ [ linux-5.3.18 ] ~ [ linux-5.2.21 ] ~ [ linux-5.1.21 ] ~ [ linux-5.0.21 ] ~ [ linux-4.20.17 ] ~ [ linux-4.19.323 ] ~ [ linux-4.18.20 ] ~ [ linux-4.17.19 ] ~ [ linux-4.16.18 ] ~ [ linux-4.15.18 ] ~ [ linux-4.14.336 ] ~ [ linux-4.13.16 ] ~ [ linux-4.12.14 ] ~ [ linux-4.11.12 ] ~ [ linux-4.10.17 ] ~ [ linux-4.9.337 ] ~ [ linux-4.4.302 ] ~ [ linux-3.10.108 ] ~ [ linux-2.6.32.71 ] ~ [ linux-2.6.0 ] ~ [ linux-2.4.37.11 ] ~ [ unix-v6-master ] ~ [ ccs-tools-1.8.12 ] ~ [ policy-sample ] ~
Architecture: ~ [ i386 ] ~ [ alpha ] ~ [ m68k ] ~ [ mips ] ~ [ ppc ] ~ [ sparc ] ~ [ sparc64 ] ~

Diff markup

Differences between /scripts/dtc/include-prefixes/dt-bindings/reset/qcom,gcc-ipq6018.h (Architecture i386) and /scripts/dtc/include-prefixes/dt-bindings/reset/qcom,gcc-ipq6018.h (Architecture mips)


  1 /* SPDX-License-Identifier: GPL-2.0 */              1 /* SPDX-License-Identifier: GPL-2.0 */
  2 /*                                                  2 /*
  3  * Copyright (c) 2018, The Linux Foundation. A      3  * Copyright (c) 2018, The Linux Foundation. All rights reserved.
  4  */                                                 4  */
  5                                                     5 
  6 #ifndef _DT_BINDINGS_RESET_IPQ_GCC_6018_H           6 #ifndef _DT_BINDINGS_RESET_IPQ_GCC_6018_H
  7 #define _DT_BINDINGS_RESET_IPQ_GCC_6018_H           7 #define _DT_BINDINGS_RESET_IPQ_GCC_6018_H
  8                                                     8 
  9 #define GCC_BLSP1_BCR                               9 #define GCC_BLSP1_BCR                           0
 10 #define GCC_BLSP1_QUP1_BCR                         10 #define GCC_BLSP1_QUP1_BCR                      1
 11 #define GCC_BLSP1_UART1_BCR                        11 #define GCC_BLSP1_UART1_BCR                     2
 12 #define GCC_BLSP1_QUP2_BCR                         12 #define GCC_BLSP1_QUP2_BCR                      3
 13 #define GCC_BLSP1_UART2_BCR                        13 #define GCC_BLSP1_UART2_BCR                     4
 14 #define GCC_BLSP1_QUP3_BCR                         14 #define GCC_BLSP1_QUP3_BCR                      5
 15 #define GCC_BLSP1_UART3_BCR                        15 #define GCC_BLSP1_UART3_BCR                     6
 16 #define GCC_BLSP1_QUP4_BCR                         16 #define GCC_BLSP1_QUP4_BCR                      7
 17 #define GCC_BLSP1_UART4_BCR                        17 #define GCC_BLSP1_UART4_BCR                     8
 18 #define GCC_BLSP1_QUP5_BCR                         18 #define GCC_BLSP1_QUP5_BCR                      9
 19 #define GCC_BLSP1_UART5_BCR                        19 #define GCC_BLSP1_UART5_BCR                     10
 20 #define GCC_BLSP1_QUP6_BCR                         20 #define GCC_BLSP1_QUP6_BCR                      11
 21 #define GCC_BLSP1_UART6_BCR                        21 #define GCC_BLSP1_UART6_BCR                     12
 22 #define GCC_IMEM_BCR                               22 #define GCC_IMEM_BCR                            13
 23 #define GCC_SMMU_BCR                               23 #define GCC_SMMU_BCR                            14
 24 #define GCC_APSS_TCU_BCR                           24 #define GCC_APSS_TCU_BCR                        15
 25 #define GCC_SMMU_XPU_BCR                           25 #define GCC_SMMU_XPU_BCR                        16
 26 #define GCC_PCNOC_TBU_BCR                          26 #define GCC_PCNOC_TBU_BCR                       17
 27 #define GCC_SMMU_CFG_BCR                           27 #define GCC_SMMU_CFG_BCR                        18
 28 #define GCC_PRNG_BCR                               28 #define GCC_PRNG_BCR                            19
 29 #define GCC_BOOT_ROM_BCR                           29 #define GCC_BOOT_ROM_BCR                        20
 30 #define GCC_CRYPTO_BCR                             30 #define GCC_CRYPTO_BCR                          21
 31 #define GCC_WCSS_BCR                               31 #define GCC_WCSS_BCR                            22
 32 #define GCC_WCSS_Q6_BCR                            32 #define GCC_WCSS_Q6_BCR                         23
 33 #define GCC_NSS_BCR                                33 #define GCC_NSS_BCR                             24
 34 #define GCC_SEC_CTRL_BCR                           34 #define GCC_SEC_CTRL_BCR                        25
 35 #define GCC_DDRSS_BCR                              35 #define GCC_DDRSS_BCR                           26
 36 #define GCC_SYSTEM_NOC_BCR                         36 #define GCC_SYSTEM_NOC_BCR                      27
 37 #define GCC_PCNOC_BCR                              37 #define GCC_PCNOC_BCR                           28
 38 #define GCC_TCSR_BCR                               38 #define GCC_TCSR_BCR                            29
 39 #define GCC_QDSS_BCR                               39 #define GCC_QDSS_BCR                            30
 40 #define GCC_DCD_BCR                                40 #define GCC_DCD_BCR                             31
 41 #define GCC_MSG_RAM_BCR                            41 #define GCC_MSG_RAM_BCR                         32
 42 #define GCC_MPM_BCR                                42 #define GCC_MPM_BCR                             33
 43 #define GCC_SPDM_BCR                               43 #define GCC_SPDM_BCR                            34
 44 #define GCC_RBCPR_BCR                              44 #define GCC_RBCPR_BCR                           35
 45 #define GCC_RBCPR_MX_BCR                           45 #define GCC_RBCPR_MX_BCR                        36
 46 #define GCC_TLMM_BCR                               46 #define GCC_TLMM_BCR                            37
 47 #define GCC_RBCPR_WCSS_BCR                         47 #define GCC_RBCPR_WCSS_BCR                      38
 48 #define GCC_USB0_PHY_BCR                           48 #define GCC_USB0_PHY_BCR                        39
 49 #define GCC_USB3PHY_0_PHY_BCR                      49 #define GCC_USB3PHY_0_PHY_BCR                   40
 50 #define GCC_USB0_BCR                               50 #define GCC_USB0_BCR                            41
 51 #define GCC_USB1_BCR                               51 #define GCC_USB1_BCR                            42
 52 #define GCC_QUSB2_0_PHY_BCR                        52 #define GCC_QUSB2_0_PHY_BCR                     43
 53 #define GCC_QUSB2_1_PHY_BCR                        53 #define GCC_QUSB2_1_PHY_BCR                     44
 54 #define GCC_SDCC1_BCR                              54 #define GCC_SDCC1_BCR                           45
 55 #define GCC_SNOC_BUS_TIMEOUT0_BCR                  55 #define GCC_SNOC_BUS_TIMEOUT0_BCR               46
 56 #define GCC_SNOC_BUS_TIMEOUT1_BCR                  56 #define GCC_SNOC_BUS_TIMEOUT1_BCR               47
 57 #define GCC_SNOC_BUS_TIMEOUT2_BCR                  57 #define GCC_SNOC_BUS_TIMEOUT2_BCR               48
 58 #define GCC_PCNOC_BUS_TIMEOUT0_BCR                 58 #define GCC_PCNOC_BUS_TIMEOUT0_BCR              49
 59 #define GCC_PCNOC_BUS_TIMEOUT1_BCR                 59 #define GCC_PCNOC_BUS_TIMEOUT1_BCR              50
 60 #define GCC_PCNOC_BUS_TIMEOUT2_BCR                 60 #define GCC_PCNOC_BUS_TIMEOUT2_BCR              51
 61 #define GCC_PCNOC_BUS_TIMEOUT3_BCR                 61 #define GCC_PCNOC_BUS_TIMEOUT3_BCR              52
 62 #define GCC_PCNOC_BUS_TIMEOUT4_BCR                 62 #define GCC_PCNOC_BUS_TIMEOUT4_BCR              53
 63 #define GCC_PCNOC_BUS_TIMEOUT5_BCR                 63 #define GCC_PCNOC_BUS_TIMEOUT5_BCR              54
 64 #define GCC_PCNOC_BUS_TIMEOUT6_BCR                 64 #define GCC_PCNOC_BUS_TIMEOUT6_BCR              55
 65 #define GCC_PCNOC_BUS_TIMEOUT7_BCR                 65 #define GCC_PCNOC_BUS_TIMEOUT7_BCR              56
 66 #define GCC_PCNOC_BUS_TIMEOUT8_BCR                 66 #define GCC_PCNOC_BUS_TIMEOUT8_BCR              57
 67 #define GCC_PCNOC_BUS_TIMEOUT9_BCR                 67 #define GCC_PCNOC_BUS_TIMEOUT9_BCR              58
 68 #define GCC_UNIPHY0_BCR                            68 #define GCC_UNIPHY0_BCR                         59
 69 #define GCC_UNIPHY1_BCR                            69 #define GCC_UNIPHY1_BCR                         60
 70 #define GCC_CMN_12GPLL_BCR                         70 #define GCC_CMN_12GPLL_BCR                      61
 71 #define GCC_QPIC_BCR                               71 #define GCC_QPIC_BCR                            62
 72 #define GCC_MDIO_BCR                               72 #define GCC_MDIO_BCR                            63
 73 #define GCC_WCSS_CORE_TBU_BCR                      73 #define GCC_WCSS_CORE_TBU_BCR                   64
 74 #define GCC_WCSS_Q6_TBU_BCR                        74 #define GCC_WCSS_Q6_TBU_BCR                     65
 75 #define GCC_USB0_TBU_BCR                           75 #define GCC_USB0_TBU_BCR                        66
 76 #define GCC_PCIE0_TBU_BCR                          76 #define GCC_PCIE0_TBU_BCR                       67
 77 #define GCC_PCIE0_BCR                              77 #define GCC_PCIE0_BCR                           68
 78 #define GCC_PCIE0_PHY_BCR                          78 #define GCC_PCIE0_PHY_BCR                       69
 79 #define GCC_PCIE0PHY_PHY_BCR                       79 #define GCC_PCIE0PHY_PHY_BCR                    70
 80 #define GCC_PCIE0_LINK_DOWN_BCR                    80 #define GCC_PCIE0_LINK_DOWN_BCR                 71
 81 #define GCC_DCC_BCR                                81 #define GCC_DCC_BCR                             72
 82 #define GCC_APC0_VOLTAGE_DROOP_DETECTOR_BCR        82 #define GCC_APC0_VOLTAGE_DROOP_DETECTOR_BCR     73
 83 #define GCC_SMMU_CATS_BCR                          83 #define GCC_SMMU_CATS_BCR                       74
 84 #define GCC_UBI0_AXI_ARES                          84 #define GCC_UBI0_AXI_ARES                       75
 85 #define GCC_UBI0_AHB_ARES                          85 #define GCC_UBI0_AHB_ARES                       76
 86 #define GCC_UBI0_NC_AXI_ARES                       86 #define GCC_UBI0_NC_AXI_ARES                    77
 87 #define GCC_UBI0_DBG_ARES                          87 #define GCC_UBI0_DBG_ARES                       78
 88 #define GCC_UBI0_CORE_CLAMP_ENABLE                 88 #define GCC_UBI0_CORE_CLAMP_ENABLE              79
 89 #define GCC_UBI0_CLKRST_CLAMP_ENABLE               89 #define GCC_UBI0_CLKRST_CLAMP_ENABLE            80
 90 #define GCC_UBI0_UTCM_ARES                         90 #define GCC_UBI0_UTCM_ARES                      81
 91 #define GCC_NSS_CFG_ARES                           91 #define GCC_NSS_CFG_ARES                        82
 92 #define GCC_NSS_NOC_ARES                           92 #define GCC_NSS_NOC_ARES                        83
 93 #define GCC_NSS_CRYPTO_ARES                        93 #define GCC_NSS_CRYPTO_ARES                     84
 94 #define GCC_NSS_CSR_ARES                           94 #define GCC_NSS_CSR_ARES                        85
 95 #define GCC_NSS_CE_APB_ARES                        95 #define GCC_NSS_CE_APB_ARES                     86
 96 #define GCC_NSS_CE_AXI_ARES                        96 #define GCC_NSS_CE_AXI_ARES                     87
 97 #define GCC_NSSNOC_CE_APB_ARES                     97 #define GCC_NSSNOC_CE_APB_ARES                  88
 98 #define GCC_NSSNOC_CE_AXI_ARES                     98 #define GCC_NSSNOC_CE_AXI_ARES                  89
 99 #define GCC_NSSNOC_UBI0_AHB_ARES                   99 #define GCC_NSSNOC_UBI0_AHB_ARES                90
100 #define GCC_NSSNOC_SNOC_ARES                      100 #define GCC_NSSNOC_SNOC_ARES                    91
101 #define GCC_NSSNOC_CRYPTO_ARES                    101 #define GCC_NSSNOC_CRYPTO_ARES                  92
102 #define GCC_NSSNOC_ATB_ARES                       102 #define GCC_NSSNOC_ATB_ARES                     93
103 #define GCC_NSSNOC_QOSGEN_REF_ARES                103 #define GCC_NSSNOC_QOSGEN_REF_ARES              94
104 #define GCC_NSSNOC_TIMEOUT_REF_ARES               104 #define GCC_NSSNOC_TIMEOUT_REF_ARES             95
105 #define GCC_PCIE0_PIPE_ARES                       105 #define GCC_PCIE0_PIPE_ARES                     96
106 #define GCC_PCIE0_SLEEP_ARES                      106 #define GCC_PCIE0_SLEEP_ARES                    97
107 #define GCC_PCIE0_CORE_STICKY_ARES                107 #define GCC_PCIE0_CORE_STICKY_ARES              98
108 #define GCC_PCIE0_AXI_MASTER_ARES                 108 #define GCC_PCIE0_AXI_MASTER_ARES               99
109 #define GCC_PCIE0_AXI_SLAVE_ARES                  109 #define GCC_PCIE0_AXI_SLAVE_ARES                100
110 #define GCC_PCIE0_AHB_ARES                        110 #define GCC_PCIE0_AHB_ARES                      101
111 #define GCC_PCIE0_AXI_MASTER_STICKY_ARES          111 #define GCC_PCIE0_AXI_MASTER_STICKY_ARES        102
112 #define GCC_PCIE0_AXI_SLAVE_STICKY_ARES           112 #define GCC_PCIE0_AXI_SLAVE_STICKY_ARES         103
113 #define GCC_PPE_FULL_RESET                        113 #define GCC_PPE_FULL_RESET                      104
114 #define GCC_UNIPHY0_SOFT_RESET                    114 #define GCC_UNIPHY0_SOFT_RESET                  105
115 #define GCC_UNIPHY0_XPCS_RESET                    115 #define GCC_UNIPHY0_XPCS_RESET                  106
116 #define GCC_UNIPHY1_SOFT_RESET                    116 #define GCC_UNIPHY1_SOFT_RESET                  107
117 #define GCC_UNIPHY1_XPCS_RESET                    117 #define GCC_UNIPHY1_XPCS_RESET                  108
118 #define GCC_EDMA_HW_RESET                         118 #define GCC_EDMA_HW_RESET                       109
119 #define GCC_ADSS_BCR                              119 #define GCC_ADSS_BCR                            110
120 #define GCC_NSS_NOC_TBU_BCR                       120 #define GCC_NSS_NOC_TBU_BCR                     111
121 #define GCC_NSSPORT1_RESET                        121 #define GCC_NSSPORT1_RESET                      112
122 #define GCC_NSSPORT2_RESET                        122 #define GCC_NSSPORT2_RESET                      113
123 #define GCC_NSSPORT3_RESET                        123 #define GCC_NSSPORT3_RESET                      114
124 #define GCC_NSSPORT4_RESET                        124 #define GCC_NSSPORT4_RESET                      115
125 #define GCC_NSSPORT5_RESET                        125 #define GCC_NSSPORT5_RESET                      116
126 #define GCC_UNIPHY0_PORT1_ARES                    126 #define GCC_UNIPHY0_PORT1_ARES                  117
127 #define GCC_UNIPHY0_PORT2_ARES                    127 #define GCC_UNIPHY0_PORT2_ARES                  118
128 #define GCC_UNIPHY0_PORT3_ARES                    128 #define GCC_UNIPHY0_PORT3_ARES                  119
129 #define GCC_UNIPHY0_PORT4_ARES                    129 #define GCC_UNIPHY0_PORT4_ARES                  120
130 #define GCC_UNIPHY0_PORT5_ARES                    130 #define GCC_UNIPHY0_PORT5_ARES                  121
131 #define GCC_UNIPHY0_PORT_4_5_RESET                131 #define GCC_UNIPHY0_PORT_4_5_RESET              122
132 #define GCC_UNIPHY0_PORT_4_RESET                  132 #define GCC_UNIPHY0_PORT_4_RESET                123
133 #define GCC_LPASS_BCR                             133 #define GCC_LPASS_BCR                           124
134 #define GCC_UBI32_TBU_BCR                         134 #define GCC_UBI32_TBU_BCR                       125
135 #define GCC_LPASS_TBU_BCR                         135 #define GCC_LPASS_TBU_BCR                       126
136 #define GCC_WCSSAON_RESET                         136 #define GCC_WCSSAON_RESET                       127
137 #define GCC_LPASS_Q6_AXIM_ARES                    137 #define GCC_LPASS_Q6_AXIM_ARES                  128
138 #define GCC_LPASS_Q6SS_TSCTR_1TO2_ARES            138 #define GCC_LPASS_Q6SS_TSCTR_1TO2_ARES          129
139 #define GCC_LPASS_Q6SS_TRIG_ARES                  139 #define GCC_LPASS_Q6SS_TRIG_ARES                130
140 #define GCC_LPASS_Q6_ATBM_AT_ARES                 140 #define GCC_LPASS_Q6_ATBM_AT_ARES               131
141 #define GCC_LPASS_Q6_PCLKDBG_ARES                 141 #define GCC_LPASS_Q6_PCLKDBG_ARES               132
142 #define GCC_LPASS_CORE_AXIM_ARES                  142 #define GCC_LPASS_CORE_AXIM_ARES                133
143 #define GCC_LPASS_SNOC_CFG_ARES                   143 #define GCC_LPASS_SNOC_CFG_ARES                 134
144 #define GCC_WCSS_DBG_ARES                         144 #define GCC_WCSS_DBG_ARES                       135
145 #define GCC_WCSS_ECAHB_ARES                       145 #define GCC_WCSS_ECAHB_ARES                     136
146 #define GCC_WCSS_ACMT_ARES                        146 #define GCC_WCSS_ACMT_ARES                      137
147 #define GCC_WCSS_DBG_BDG_ARES                     147 #define GCC_WCSS_DBG_BDG_ARES                   138
148 #define GCC_WCSS_AHB_S_ARES                       148 #define GCC_WCSS_AHB_S_ARES                     139
149 #define GCC_WCSS_AXI_M_ARES                       149 #define GCC_WCSS_AXI_M_ARES                     140
150 #define GCC_Q6SS_DBG_ARES                         150 #define GCC_Q6SS_DBG_ARES                       141
151 #define GCC_Q6_AHB_S_ARES                         151 #define GCC_Q6_AHB_S_ARES                       142
152 #define GCC_Q6_AHB_ARES                           152 #define GCC_Q6_AHB_ARES                         143
153 #define GCC_Q6_AXIM2_ARES                         153 #define GCC_Q6_AXIM2_ARES                       144
154 #define GCC_Q6_AXIM_ARES                          154 #define GCC_Q6_AXIM_ARES                        145
155 #define GCC_UBI0_CORE_ARES                        155 #define GCC_UBI0_CORE_ARES                      146
156                                                   156 
157 #endif                                            157 #endif
158                                                   158 

~ [ source navigation ] ~ [ diff markup ] ~ [ identifier search ] ~

kernel.org | git.kernel.org | LWN.net | Project Home | SVN repository | Mail admin

Linux® is a registered trademark of Linus Torvalds in the United States and other countries.
TOMOYO® is a registered trademark of NTT DATA CORPORATION.

sflogo.php