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TOMOYO Linux Cross Reference
Linux/include/dt-bindings/clock/qcom,gcc-qcs404.h

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  1 /* SPDX-License-Identifier: GPL-2.0 */
  2 /*
  3  * Copyright (c) 2018, The Linux Foundation. All rights reserved.
  4  */
  5 
  6 #ifndef _DT_BINDINGS_CLK_QCOM_GCC_QCS404_H
  7 #define _DT_BINDINGS_CLK_QCOM_GCC_QCS404_H
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130 #define GCC_USB_HS_INACTIVITY_TIMERS_CLK                122
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135 #define GCC_MDSS_MDP_VOTE_CLK                           127
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137 #define GCC_BIMC_GPU_CLK                                129
138 #define GCC_GTCU_AHB_CLK                                130
139 #define GCC_GFX_TCU_CLK                                 131
140 #define GCC_GFX_TBU_CLK                                 132
141 #define GCC_SMMU_CFG_CLK                                133
142 #define GCC_APSS_TCU_CLK                                134
143 #define GCC_CRYPTO_AHB_CLK                              135
144 #define GCC_CRYPTO_AXI_CLK                              136
145 #define GCC_CRYPTO_CLK                                  137
146 #define GCC_MDP_TBU_CLK                                 138
147 #define GCC_QDSS_DAP_CLK                                139
148 #define GCC_DCC_XO_CLK                                  140
149 #define GCC_WCSS_Q6_AHB_CLK                             141
150 #define GCC_WCSS_Q6_AXIM_CLK                            142
151 #define GCC_CDSP_CFG_AHB_CLK                            143
152 #define GCC_BIMC_CDSP_CLK                               144
153 #define GCC_CDSP_TBU_CLK                                145
154 #define GCC_CDSP_BIMC_CLK_SRC                           146
155 
156 #define GCC_GENI_IR_BCR                                 0
157 #define GCC_USB_HS_BCR                                  1
158 #define GCC_USB2_HS_PHY_ONLY_BCR                        2
159 #define GCC_QUSB2_PHY_BCR                               3
160 #define GCC_USB_HS_PHY_CFG_AHB_BCR                      4
161 #define GCC_USB2A_PHY_BCR                               5
162 #define GCC_USB3_PHY_BCR                                6
163 #define GCC_USB_30_BCR                                  7
164 #define GCC_USB3PHY_PHY_BCR                             8
165 #define GCC_PCIE_0_BCR                                  9
166 #define GCC_PCIE_0_PHY_BCR                              10
167 #define GCC_PCIE_0_LINK_DOWN_BCR                        11
168 #define GCC_PCIEPHY_0_PHY_BCR                           12
169 #define GCC_EMAC_BCR                                    13
170 #define GCC_CDSP_RESTART                                14
171 #define GCC_PCIE_0_AXI_MASTER_STICKY_ARES               15
172 #define GCC_PCIE_0_AHB_ARES                             16
173 #define GCC_PCIE_0_AXI_SLAVE_ARES                       17
174 #define GCC_PCIE_0_AXI_MASTER_ARES                      18
175 #define GCC_PCIE_0_CORE_STICKY_ARES                     19
176 #define GCC_PCIE_0_SLEEP_ARES                           20
177 #define GCC_PCIE_0_PIPE_ARES                            21
178 #define GCC_WDSP_RESTART                                22
179 
180 /* Indexes for GDSCs */
181 #define MDSS_GDSC                               0
182 #define OXILI_GDSC                              1
183 
184 #endif
185 

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